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申请/专利权人：泰瑞达公司
摘要：电路及其操作方法以将信号延迟精确且可变的量。一个实施方案涉及一种在自动化测试设备中使用的高速延迟线。本发明人已经认识到并理解，具有高数据速率的输入信号可被分离成具有较低数据速率的并行分离信号，该并行分离信号在被组合以生成延迟信号之前在相应的并行延迟路径中被延迟。以这种方式延迟信号的一个优点是在高数据速度下提供高延迟线时序精度，同时使用紧凑电路设计，该设计使用较低带宽的电路部件并降低功耗，例如通过使用互补金属氧化物半导体CMOS。另一优点是高速延迟线可由模块化的多个较低数据速率的并行延迟线构造，从而简化电路设计。
主权项：1.一种用于延迟信号的装置，所述装置包括：分离器电路，所述分离器电路包括输入和N个输出，其中：N至少为二，并且所述分离器电路被配置成在所述输入处接收具有第一数据速率的输入信号并且在相应输出处生成N个分离信号，所述N个分离信号中的每个分离信号具有小于所述第一数据速率的数据速率；和延迟电路，所述延迟电路被配置成基于所述N个分离信号生成延迟信号，其中所述延迟信号是具有延迟的所述输入信号，所述N个输出包括第一输出和第二输出，所述分离器电路被配置成在所述第一输出处生成第一分离信号并且在所述第二输出处生成第二分离信号，所述输入信号以及所述第一分离信号和所述第二分离信号中的每一者具有多个上升边缘和下降边缘，所述分离器电路被配置成响应于所述输入信号的上升边缘在所述第一输出处但不在所述第二输出中生成第一边缘，并且所述分离器电路被配置成响应于所述输入信号的下降边缘在所述第二输出处但不在所述第一输出中生成第二边缘。
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