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申请/专利权人：北京士模微电子有限责任公司

摘要：本公开涉及一种能够抵消电介质吸收效应的采样电路及装置。电路包括两个含有多个采样单元的采样保持电路和开关控制模块，采样单元包括第一电容和第二电容，至少部分采样单元的目标容值比相同；开关控制模块在采样阶段控制第一采样保持电路内各电容的底板接入VIP，控制第二采样保持电路内各电容底板接入VIN，控制各第一电容顶板接VDD、各第二电容顶板接地；在转换阶段控制采样保持电路中电容与VIP、VIN断开，并控制第一采样保持电路中电容顶板、第二采样保持电路中电容顶板分别与比较器的正、负输入端之间的连接导通。可抵消电介质吸收效应带来的影响，结构简单，有效改善ADC长时间采样后THD以及DNLINL恶化的现象。

主权项：1.一种能够抵消电介质吸收效应的采样电路，其特征在于，所述电路包括两个采样保持电路和开关控制模块，各所述采样保持电路包括多个采样单元，各所述采样单元包括第一电容和第二电容，多个采样单元中至少部分采样单元所对应的目标容值比相同，各所述采样单元的目标容值比为该采样单元中第一电容和第二电容的电容值之比；相邻位的两个所述采样单元中高位采样单元的电容总值是低位采样单元的电容总值的预设倍数，各所述采样单元的电容总值为该采样单元中所述第一电容和所述第二电容的电容值之和；所述开关控制模块，用于在采样阶段控制所述采样保持电路中第一采样保持电路内的各第一电容的底板、各第二电容的底板与差分信号对的正输入信号的第一输入端之间的连接导通，以及在采样阶段控制所述采样保持电路中第二采样保持电路内的各第一电容的底板、各第二电容的底板与所述差分信号对的负输入信号的第二输入端之间的连接导通，并控制各所述第一电容的顶板连接到电源电压以及控制各所述第二电容的顶板接地；以及在转换阶段控制所述第一采样保持电路中各第一电容的底板、各第二电容的底板与所述第一输入端之间的连接断开，以及在转换阶段控制所述第二采样保持电路中各第一电容的底板、各第二电容的底板与所述第二输入端之间的连接断开，并控制所述第一采样保持电路中各第一电容的顶板、各第二电容的顶板与比较器的正输入端之间的连接导通以及控制所述第二采样保持电路中各第一电容的顶板、各第二电容的顶板与所述比较器的负输入端之间的连接导通。

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