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摘要：本发明提供了基于FPGA的高速CBC加密传输方法和系统，包括：输入总缓存接收不同报文，监测N个输入子缓存的状态；当状态为空时，读取当前报文，将当前报文存入输入子缓存中；输入子缓存将当前报文根据加密模块输入数据格式，拆分为多个明文数据单元；CBC加密模块以N个时钟为周期，对多个明文数据单元分别进行加密处理得到多个密文数据单元；报文顺序控制模块根据输入总缓存的读出顺序，记录每个报文对应的加密时隙通道的序号；根据加密时隙通道的序号监控对应的输出子缓存的状态；当输出子缓存的状态为非空时，报文顺序控制模块向输出子缓存发送报文输出指令；输出子缓存根据报文输出指令，将密文数据单元处理为报文后输出。
主权项：1.一种基于FPGA的高速CBC加密传输方法，其特征在于，应用于加密传输系统，所述加密传输系统包括CBC加密模块、输入缓存区、输出缓存区和报文顺序控制模块，所述输入缓存区包括输入总缓存和N个输入子缓存，所述输出缓存区包括N个输出子缓存；所述方法包括：所述输入总缓存接收不同报文，并监测N个所述输入子缓存的状态；当所述输入子缓存的状态为空时，读取当前报文，并将所述当前报文存入所述输入子缓存中；所述输入子缓存将所述当前报文根据加密模块输入数据格式，拆分为多个明文数据单元；所述CBC加密模块以N个时钟为周期，对多个所述明文数据单元分别进行加密处理，得到多个密文数据单元；所述报文顺序控制模块根据所述输入总缓存的读出顺序，记录每个所述报文对应的加密时隙通道的序号；所述报文顺序控制模块根据所述加密时隙通道的序号监控对应的所述输出子缓存的状态；当所述输出子缓存的状态为非空时，所述报文顺序控制模块向所述输出子缓存发送报文输出指令；所述输出子缓存根据所述报文输出指令，将所述密文数据单元处理为所述报文后输出。
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