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摘要：本发明涉及一种高速串行扩展的ASIC原型验证FPGA集群，包括主FPGA节点和若干从FPGA节点，形成高速串行数据链路；各从FPGA节点的高速串行接口通过总线桥扩展出异步总线，用于对所述从FPGA节点ASIC原型验证待测设计监测、控制；所述主FPGA节点用于通过高速串行数据链路收发数据帧对各从FPGA节点ASIC原型验证待测设计监测、控制；各从FPGA节点用于通过高速串行数据链路收发并解析数据帧，节点ID指向的从FPGA节点通过异步总线将数据帧TX字段状态写入所述从FPGA节点ASIC原型验证待测设计、获取所述从FPGA节点ASIC原型验证待测设计状态写入数据帧RX字段，节点ID不指向的从FPGA节点通过高速串行数据链路将所述数据帧透传到下一个FPGA节点。有益效果是具备高可复制性、高可扩展性。
主权项：1.一种高速串行扩展的ASIC原型验证FPGA集群，其特征在于：包括主FPGA节点和若干从FPGA节点，所述FPGA节点包括基于高速串行数据恢复技术构建的高速串行接口，所述主FPGA节点高速串行接口与从FPGA节点高速串行接口连接，从FPGA节点高速串行接口与下一个从FPGA节点高速串行接口连接，形成高速串行数据链路；各从FPGA节点的高速串行接口通过总线桥扩展出异步总线，用于对所述从FPGA节点ASIC原型验证待测设计监测、控制；所述主FPGA节点用于通过高速串行数据链路收发数据帧对各从FPGA节点ASIC原型验证待测设计监测、控制，所述数据帧包括节点ID字段、对从FPGA节点ASIC原型验证待测设计控制的TX字段和对从FPGA节点ASIC原型验证待测设计监测的RX字段；各从FPGA节点用于通过高速串行数据链路收发并解析数据帧，节点ID指向的从FPGA节点通过异步总线将数据帧TX字段状态写入所述从FPGA节点ASIC原型验证待测设计、获取所述从FPGA节点ASIC原型验证待测设计状态写入数据帧RX字段，节点ID不指向的从FPGA节点通过高速串行数据链路将所述数据帧透传到下一个FPGA节点。
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百度查询： 北京辉羲智能科技有限公司 一种高速串行扩展的ASIC原型验证FPGA集群
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