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申请/专利权人：江苏华创微系统有限公司

摘要：本发明公开了一种基于JESD204B协议的多通道同步采集传输系统，包括多通道AD同步采集模块、信号源模块、电源模块和上位机模块：信号源模块向多通道AD同步采集模块发送参考时钟和多个模拟信号；多通道AD同步采集模块包括FPGA、多通道ADC、独立时钟源和多个器件；利用独立时钟源接收参考时钟，并传输sysref参考信号；在多通道ADC中设置时间窗口；FPGA生成sync同步信号，合成LMFC多帧时钟，以sysref参考信号的边沿作为LMFC多帧时钟的边沿；在多通道ADC中为每个数字信号设置对应的每个ILAS序列；FPGA接收到全部ILAS序列和数字信号，选取LMFC多帧时钟的下一个最近边沿作为起始点同时对多个数字信号进行处理。本发明将多个信号和时钟进行对齐，设置缓冲同步处理，实现低延迟多通道同步传输。

主权项：1.一种基于JESD204B协议的多通道同步采集传输系统，包括多通道AD同步采集模块、电源模块、上位机模块和信号源模块；电源模块为多通道AD同步采集模块进行供电，上位机模块通过网线连接多通道AD同步采集模块，信号源模块向多通道AD同步采集模块传输多个模拟信号，其特征在于：所述信号源模块至少包括信号源1和信号源2，信号源1向多通道AD同步采集模块发送参考时钟，信号源2向多通道AD同步采集模块发送多个模拟信号，每个模拟信号对应一个通道；所述多通道AD同步采集模块至少包括FPGA、多通道ADC、独立时钟源和符合subclass1规范的多个器件；其中，独立时钟源、多通道ADC和FPGA之间通过多个JESD204B接口两两相连；利用独立时钟源接收信号源1发送的参考时钟，同时基于所述参考时钟向多通道ADC和FPGA传输sysref参考信号；在多通道ADC中设置时间窗口，并控制多通道ADC接收的sysref参考信号的边沿落在所述时间窗口内；利用FPGA生成sync同步信号，利用sync同步信号和FPGA接收的sysref参考信号合成LMFC多帧时钟，同时以FPGA接收的sysref参考信号的边沿作为LMFC多帧时钟的边沿；在多通道ADC中为每个数字信号设置对应的每个ILAS序列，多通道ADC依据LMFC多帧时钟向FPGA发送每个ILAS序列和对应的每个数字信号；在FPGA接收到全部的ILAS序列和对应的全部数字信号后，选取LMFC多帧时钟的下一个最近边沿作为起始点对全部数字信号同时进行处理，实现多通道同步采集传输。

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