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申请/专利权人：电子科技大学

摘要：本发明提出了一种基于T'触发器的计数电路，能准确切换加减状态，属于集成电路领域。本发明主要由T'触发器和选择模块AND‑MUX，以下简称AMUX级联组成，通过改进选择模块的结构，使整个计数电路在切换计数状态时，不仅保留了前级触发器传递的有效信息，并且使下级触发器的输入电平保持不变，避免产生干扰信息造成误翻转，从而正确切换计数状态并保留计数值。本发明中通过对选择模块的改进，不仅可以在输入脉冲信号为低电平时自由切换并且正确切换计数状态，同时在保证功能正确的情况下减少了晶体管数量，降低了一定的功耗和面积。可应用于递增计数，递减计数，加减混合计数等逻辑电路。

主权项：1.一种基于T'触发器的计数电路，其特征在于：能够准确切换加减状态，包括多个依次连接的T'触发器和选择模块AMUX；第一T'触发器的输入为外部脉冲SPIKE，第一T'触发器的直接输出连接第一选择模块AMUX的D0节点，第一T'触发器的反向输出连接第一选择模块AMUX的D1节点，外部脉冲连接第一选择模块AMUX的C节点，外部选择信号SEL连接各个选择模块AMUX的S节点；第一选择模块AMUX的输出节点Y作为下一T'触发器的输入及下一选择模块AMUX的C节点的输入；后续T'触发器及选择模块AMUX的连接方式第一T'触发器与第一选择模块AMUX的连接方式相同；选择模块AMUX中共包括6个NMOS管T1～T6和2个非门NOT1～NOT2；第一NMOS管T1，第二NMOS管T2和第一非门NOT1构成一个与门，第三NMOS管T3，第四NMOS管T4和第一非门NOT1构成一个与门，以及第五NMOS管T5，第六NMOS管T6和第二非门NOT2构成一个二路选择器；具体地，第一NMOS管T1的漏极与节点D0连接，第一NMOS管T1的栅极与节点C以及第一非门NOT1的输入连接，第一NMOS管T1的源极连接第二NMOS管T2的漏极及第五NMOS管T5的漏极，连接点为节点M；第二NMOS管T2的栅极连接第一非门NOT1的输出及第四NMOS管T4的栅极，连接点为节点第二NMOS管T2的源极接地；第三NMOS管T3的漏极与节点D1连接，第三NMOS管T3的栅极与节点C连接，第三NMOS管T3的源极连接第四NMOS管T4的漏极与第六NMOS管T6的漏极，连接点为节点N；第五NMOS管T5的栅极连接第二非门NOT2的输出，连接点为第二非门NOT2的输入与节点S连接，第六NMOS管T6的栅极连接节点S；第五NMOS管T5与第六NMOS管T6的源极共同连接至输出节点Y。

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百度查询： 电子科技大学 一种基于T'触发器的计数电路