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申请/专利权人：苏州旗芯微半导体有限公司

摘要：本发明揭示了一种支持解锁的锁步核电路，包括输入输出模块、第一核、第二核、第一缓存、第二缓存、第一延迟单元、第一选择器、第二延时单元、第一比较器，所述第一选择器的选择端、所述第一比较器的使能端均接收解锁控制信号；当所述解锁控制信号为第一数值，所述第一核、所述第二核共同构成锁步核模式；当所述解锁控制信号为第二数值，所述第一核、所述第二核分别为独立核模式；在所述锁步核模式和所述独立核模式下，所述第一核均仅与所述第一缓存进行指令和数据存取，所述第二核均仅与所述第二缓存进行指令和数据存取。本发明的系统安全性较高。

主权项：1.一种支持解锁的锁步核电路，其特征在于，所述支持解锁的锁步核电路包括输入输出模块、第一核、第二核、第一缓存、第二缓存、第一延迟单元、第一选择器、第二延时单元、第一比较器，所述输入输出模块的输出发送给所述第一核，所述输入输出模块的输出还经由所述第一延迟单元发送给所述第一选择器的第一输入端，所述第一核的输出发送给所述输入输出模块，所述第一核的输出还经由所述第二延迟单元发送给所述第一比较器的第一输入端，所述输入输出模块的输出还发送给所述第一选择器的第二输入端，所述第一选择器的输出发送给所述第二核，所述第二核的输出发送给所述输入输出模块，所述第二核的输出还发送给所述第一比较器的第二输入端，所述第一选择器的选择端、所述第一比较器的使能端均接收解锁控制信号；所述解锁控制信号具有两种数值，当所述解锁控制信号为第一数值，所述第一选择器选择所述输入输出模块的输出经由所述第一延迟单元延迟以及所述第一选择器发送给所述第二核，所述第一比较器为工作状态，对所述第一核的输出经由所述第二延迟单元延迟与所述第二核的输出进行比较，输出第一锁步检查结果，所述第一核、所述第二核共同构成锁步核模式；当所述解锁控制信号为第二数值，所述第一选择器选择所述输入输出模块的输出直接经由所述第一选择器发送给所述第二核，所述第一比较器为非工作状态，不进行比较，所述第一核、所述第二核分别为独立核模式；所述第一核与所述第一缓存连接，所述第二核与所述第二缓存连接，在所述锁步核模式和所述独立核模式下，所述第一核均仅与所述第一缓存进行指令和数据存取，所述第二核均仅与所述第二缓存进行指令和数据存取。

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