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申请/专利权人：中国人民解放军国防科技大学
摘要：本申请涉及一种基于ZYNQ与M‑LVDS总线的自适应数据交互系统。所述系统包括ZYNQ和M‑LVDS控制总线，ZYNQ包括PS和PL两个模块，PS模块通过ARM处理器实现操作系统和应用程序的配置与运行，并通过DDR内存控制器对外接DDR内存进行高效处理。PL包括DMA控制器和波特率自适应决策模块。DMA控制器接收ARM指令，将数据从DDR内存中读入总线控制器的FIFO中。波特率自适应决策模块则负责对数据帧进行计数，并根据自适应调整规则，对不同长度的数据设置不同的波特率，提高总线的利用效率。采用本系统能够提高数据传输效率。
主权项：1.一种基于ZYNQ与M-LVDS总线的自适应数据交互系统，其特征在于，所述系统包括ZYNQ、M-LVDS总线控制器和M-LVDS控制总线；所述ZYNQ包括PS模块和PL模块；所述PL模块包括DMA控制器和波特率自适应决策模块；所述PS模块将待发送数据帧写入DDR内存，并对DMA控制器的发送通道进行配置，包括数据发送方向、数据帧长度、缓存地址；所述DMA控制器接收ARM指令，将数据帧从DDR内存中读取出来，将其存入M-LVDS总线控制器的FIFO单元，数据帧进入FIFO单元后触发数据发送请求给总线控制器，总线控制器分别进行总线仲裁和CRC校验，判断数据帧的发送优先级，并生成CRC校验值附在数据帧末尾；所述波特率自适应决策模块用于对数据帧发送过程中上位机的波特率进行实时监测并将测量得到的结果与自适应调整规则比对，对波特率进行重新设置，实现不同长度数据帧的自适应传输决策；所述M-LVDS总线控制器检测到FIFO不为空时，即触发数据发送请求，对处理过的数据帧进行并串转换，按照自适应调整后的波特率将数据发送到M-LVDS总线上，再对M-LVDS总线上的数据进行串行采集，并进行数据的串并转换和数据帧解析，将校验正确的数据存入FIFO单元，对DMA控制器的接收通道进行配置；所述DMA控制器按照配置和控制指令，将数据从FIFO中读入DDR内存，当数据搬移完成后，DMA产生中断告知处理器，DMA数据搬运完成。
全文数据：
权利要求：
百度查询： 中国人民解放军国防科技大学 基于ZYNQ与M-LVDS总线的自适应数据交互系统
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