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申请/专利权人：广东工业大学
摘要：本发明公开了一种内置ECC的纠错型FIFO电路结构，包括：两个或两个以上的BCH编码模块、存放信息位的FIFO存储器、存放冗余位的FIFO存储器以及BCH解码模块，其中：所述两个或两个以上的BCH编码模块并行布置，输入的信息位被拆分成多段交替写入BCH编码模的同时，写入到存放信息位的FIFO存储器中；BCH编码模块用于根据信息位产生冗余位，并将冗余位存储到所述的存放冗余位的FIFO存储器中；BCH解码模块依次读取存放信息位的FIFO存储器中存储的信息位和存放冗余位的FIFO存储器中存储的冗余位，并检测由信息位和冗余位构成的码字是否出错；若出现错误，则查找出错的位置并进行错误纠正，输出纠错后的信息位；若没有错误，则直接输出信息位。
主权项：1.一种内置ECC的纠错型FIFO电路结构，其特征在于，包括：两个或两个以上的BCH编码模块、存放信息位的FIFO存储器、存放冗余位的FIFO存储器以及BCH解码模块，其中：所述两个或两个以上的BCH编码模块并行布置，输入的信息位被拆分成多段交替写入BCH编码模的同时，写入到存放信息位的FIFO存储器中；BCH编码模块用于根据信息位产生冗余位，并将冗余位存储到所述的存放冗余位的FIFO存储器中；BCH解码模块依次读取存放信息位的FIFO存储器中存储的信息位和存放冗余位的FIFO存储器中存储的冗余位，并检测由信息位和冗余位构成的码字是否出错；若出现错误，则查找出错的位置并进行错误纠正，输出纠错后的信息位；若没有错误，则直接输出信息位。
全文数据：
权利要求：
百度查询： 广东工业大学 一种内置ECC的纠错型FIFO电路结构
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