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申请/专利权人：山东浪潮科学研究院有限公司
摘要：本发明目的是提供了一种PCB设计中检查布线是否跨分割的方法，包括以下步骤：根据PCB叠层对所有走线按照ETCH层进行分类；检测每个ETCH层的相邻层是否为PLANElayer；用户选择需要被检查的ETCH层，计算其中一段完整的cline坐标是否全部在PLANE的坐标点区域内；如果不在，判定为跨分割并标记；对所有需检查的ETCH层采用同样方法处理。本发明可以让layout工程师摆脱手动检查的繁杂工作，达到高效准确的目的。
主权项：1.一种PCB设计中检查布线是否跨分割的方法，其特征在于，包括以下步骤：S1修改Allegro软件的配置文件，将配置文件allegro.men放在Allegro安装路径下的\Cadence\SPB_16.6\share\pcb\text\cuimenus目录下，该目录存放allegro软件的菜单配置文件，通过修改代码修改软件的菜单界面；S2添加skill初始化文件，使Allegro软件启动时自动载入skill程序；S3启动程序；S4根据PCB叠层对所有走线按照ETCH层进行分类；S5检测每个ETCH层的相邻层是否为PLANElayer；S6用户选择需要被检查的ETCH层，计算其中一段完整的cline坐标是否全部在PLANE的坐标点区域内：所述一段完整的cline为被检测对象的其中一个完整小个体，如果整个ETCH层面中所有的完整的cline都没有跨分割的情况即为本层面无跨分割情况，一段完整的cline的位置通过这根cline拐角处的坐标值来定位，通过连接定位坐标连线即为整段cline所在的位置；一段完整的cline相邻PLANE层面内部有不同形状不同属性的铜皮区域，不同铜皮区域之间有间隙，如果cline横跨这个间隙即为跨分割；通过检测一段完整的cline上所有拐角处的坐标是否全部在相邻层PLANE的铜皮区域上来判断这段cline是否出现跨分割的情况；S7如果不在，判定为跨分割并标记；S8对所有需检查的ETCH层采用同样方法处理。
全文数据：
权利要求：
百度查询： 山东浪潮科学研究院有限公司 一种PCB设计中检查布线是否跨分割的方法
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