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申请/专利权人：江苏华创微系统有限公司
摘要：本实用新型公开了一种基于FPGA实现PCIE与RapidIO协议互联的系统，包括依次连接的RapidIO交换机、FPGA和CPU，RapidIO交换机通过RapidIOX4插槽与FPGA连接，CPU通过PCIEX4插槽与FPGA连接，FPGA包括数据流控制器、bram、多个RapidIO接口和多个PCIE接口；数据流控制器与bram相连；数据流控制器和bram均连接RapidIOX4插槽和PCIEX4插槽。本实用新型用分层结构的bram为缓存，省略了DDR3的使用，有效降低成本，还将主要传输任务放在FPGA内部，简化对CPU的架构要求，拓宽使用场景。
主权项：1.一种基于FPGA实现PCIE与RapidIO协议互联的系统，其特征在于，包括依次连接的RapidIO交换机、FPGA和CPU，RapidIO交换机通过RapidIOX4插槽与FPGA连接，CPU通过PCIEX4插槽与FPGA连接，FPGA包括数据流控制器、bram、多个RapidIO接口和多个PCIE接口；其中，数据流控制器与bram相连，多个RapidIO接口包括RapidIO枚举接口、Nread接口和Nwrite接口，多个PCIE接口包括IO低速读写接口、中断接口和memory高速读写接口；数据流控制器通过RapidIO枚举接口与RapidIOX4插槽相连，数据流控制器还通过并行的IO低速读写接口和中断接口连接PCIEX4插槽；bram通过并行的Nread接口和Nwrite接口连接RapidIOX4插槽，bram还通过memory高速读写接口与PCIEX4插槽相连。
全文数据：
权利要求：
百度查询： 江苏华创微系统有限公司 一种基于FPGA实现PCIE与RapidIO协议互联的系统
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