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申请/专利权人：英特尔公司
摘要：关于基于脉动阵列的FPGA叠覆卷积神经网络CNN加速器的3DCNN实现。提供了集成电路器件、方法和电路，用于使得基于FPGA的二维2D脉动阵列CNN加速器能够对在时间或空间维度上具有额外维度的三维3D输入数据进行操作。针对3DCNN加速器提供了用于三维3D卷积、3D折叠和3D池化的技术、方法和电路。提供了深度计数器来通过2DCNN加速器馈送3D输入数据和过滤数据以产生可以高效地对3D输入数据进行操作的3DCNN加速器。
主权项：1.一种用于处理卷积操作的设备，所述设备包括：缓冲器，被配置为从输入馈送器接收特征数据，其中输入馈送器包括计数器；和处理元件PE阵列，被配置为：从输入馈送器接收多个过滤器的过滤数据；基于由计数器提供的参数从缓冲器接收特征数据的集合，其中特征数据的集合包括多个维度，并且其中参数沿着多个维度之一；和使用过滤数据和特征数据的集合处理卷积操作，其中多个过滤器被配置为在卷积操作中沿着多个维度中的每一个跨步特征数据的集合。
全文数据：
权利要求：
百度查询： 英特尔公司 关于基于脉动阵列的FPGA叠覆卷积神经网络（CNN）加速器的3D CNN实现
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