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摘要：本公开提供了一种用于SAR雷达的可重构数字收发装置，应用于雷达信号技术领域，包括：可重构FPGA芯片、CLK芯片、DAC芯片和ADC芯片，可重构FPGA芯片加载静态逻辑区和两个动态可重配置区的程序，接收雷达系统的工作指令，确定装置的工作模式。在工作模式确定后，配置CLK芯片产生ADC芯片和DAC芯片的工作时钟，根据工作模式选择动态可重配置区，并将采集后的数据通过光纤接口传送至后续信号处理单元。本公开还提供了一种电子设备。

主权项：1.一种用于SAR雷达的可重构数字收发装置，其特征在于，包括：可重构FPGA芯片，包括静态逻辑区和至少两个动态可重配置区，所述静态逻辑区用于接收雷达系统发出的时钟配置指令和工作指令，并根据所述时钟配置指令生成时钟工作参数，以及，根据所述工作指令确定工作模式，所述工作模式包括信号生成模式和信号采集模式，当所述工作模式包括信号生成模式时，加载一动态可重配置区，所述一动态可重配置区用于根据所述工作模式生成数字调频波形信号，当所述工作模式包括信号采集模式时，加载另一动态可重配置区，所述另一所述动态可重配置区用于根据所述工作模式生成信号采集指令；CLK芯片，用于根据所述时钟工作参数配置生成ADC芯片和DAC芯片的工作时钟；所述DAC芯片，用于在所述工作模式包括信号生成模式的情况下，基于所述DAC芯片的工作时钟和所述数字调频波形信号，生成第一模拟线性调频信号和第二模拟线性调频信号，并将所述第一模拟线性调频信号和所述第二模拟线性调频信号输出给所述雷达系统；所述ADC芯片，用于在所述工作模式包括信号采集模式的情况下，基于所述信号采集指令接收所述雷达系统发送的第一模拟采集信号和第二模拟采集信号，并基于所述ADC芯片的工作时钟对所述第一模拟采集信号和所述第二模拟采集信号进行模数转换，得到第一数字采集信号和第二数字采集信号；低频接口，用于接收所述雷达系统的控制信号，将所述控制信号发送给所述可重构FPGA芯片，以及，发送所述可重构数字收发装置的遥测信息给所述雷达系统；所述可重构FPGA芯片，还用于接收所述第一数字采集信号和所述第二数字采集信号，并将所述第一数字采集信号和所述第二数字采集信号按照预设格式打包，得到原始回波数据，将所述原始回波数据发送给所述雷达系统；高频接口，用于接收所述雷达系统发送的基准时钟，并将基准时钟发送给所述CLK芯片。

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百度查询： 中国科学院空天信息创新研究院 西北工业大学 用于SAR雷达的可重构数字收发装置和电子设备