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一种支持多编码方式的低功耗神经元电路 

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摘要:本发明涉及一种支持多编码方式的低功耗神经元电路,该神经元电路包括两级灵敏放大器结构和相应的逻辑控制电路,具体为:输入脉冲信号通过延时控制产生第一级灵敏放大器的使能信号,第一级灵敏放大器将神经元膜电容的电位Vmem与第一级阈值电压Vrefs比较,决定是否产生第二级灵敏放大器的使能信号;第二级灵敏放大器的输出通过SR锁存器产生输出脉冲信号,进一步地,输出脉冲信号根据当前输入配置信号的情况,对神经元的复位进行控制。与现有技术相比,本发明具有低功耗、支持多编码方式的优点。

主权项:1.一种支持多编码方式的低功耗神经元电路,其特征在于,该神经元电路包括两级灵敏放大器结构和相应的逻辑控制电路,具体为:输入脉冲信号通过延时控制产生第一级灵敏放大器的使能信号,第一级灵敏放大器将神经元膜电容的电位Vmem与第一级阈值电压Vrefs比较,决定是否产生第二级灵敏放大器的使能信号;第二级灵敏放大器的使能信号有效时,第二级灵敏放大器将神经元膜电容的电位Vmem与第二级阈值电压Vref比较,第二级灵敏放大器的输出通过SR锁存器存储并决定是否产生输出脉冲信号,输出脉冲信号与输入配置信号经过逻辑控制电路对神经元的复位行为进行控制。

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