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龙图腾网恭喜深圳比特微电子科技有限公司申请的专利用于执行散列算法的运算电路、芯片和计算装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN111813452B 。

龙图腾网通过国家知识产权局官网在2025-05-06发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202010837928.0，技术领域涉及：G06F9/38；该发明授权用于执行散列算法的运算电路、芯片和计算装置是由范志军;刘建波;杨作兴设计研发完成，并于2020-08-19向国家知识产权局提交的专利申请。

本用于执行散列算法的运算电路、芯片和计算装置在说明书摘要公布了：本公开涉及用于执行散列算法的运算电路、芯片和计算装置。执行散列算法的运算电路，包括以流水线结构布置的多个运算级，每个运算级包括：一组输入和一组输出，输入对应耦接到前一运算级的输出，输出对应耦接到后一运算级的输入；多个组合逻辑模块，每一个的输入耦接到一组输入中至少一部分；多个延时模块，每一个的输入耦接到一组输入之一，输出耦接到一组输出中的不与组合逻辑模块相耦接的一个，使这样的输出各自耦接到一个延时模块；多个补充延时模块，每一个的输入耦接到对应组合逻辑模块的输出，输出耦接到一组输出之一，其中，每个延时模块和补充延时模块由串联的相同延时单元构成，使从每个运算级的输入到输出中每一个的计算延时基本相等。

本发明授权用于执行散列算法的运算电路、芯片和计算装置在权利要求书中公布了：1.一种用于执行散列算法的运算电路，其特征在于，所述运算电路包括以流水线结构布置的多个运算级，其中每个运算级包括：一组输入和一组输出，所述一组输入对应地耦接到前一运算级的一组输出，并且所述一组输出对应地耦接到后一运算级的一组输入；多个组合逻辑模块，每个组合逻辑模块的输入耦接到所述一组输入中的至少一部分；多个延时模块，每个延时模块的输入耦接到所述一组输入中的一个，并且输出耦接到所述一组输出中的不与组合逻辑模块相耦接的一个，使得所述一组输出中的不与组合逻辑模块相耦接的输出各自耦接到一个延时模块；以及多个补充延时模块，每个补充延时模块的输入耦接到对应的组合逻辑模块的输出，并且输出耦接到所述一组输出中的一个，其中，每个运算级的延时模块和补充延时模块中的每一个由串联连接的相同的延时单元构成，并且被配置为使得从每个运算级的所述一组输入到所述一组输出中的每一个的计算延时基本相等。

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