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申请/专利权人：厦门芯矽望集成电路技术有限公司
摘要：本实用新型公开了一种RISCV系统内存的调试电路，以控制调试模块与RISCV内核对内存的分时读写。其内核使能内存电路中，第一或门的两输入端分别连接RISCV内核的读写信号，第一与门的两输入端分别连接第一或门的输出端及RISCV内核地址与内存地址匹配信号，输出端连接内核对内存使能信号；其调试模块使能内存电路中，第一或非门的两输入端分别连接RISCV内核获取读写信号，第二与门的三输入端分别连接第一或非门的输出端、调试模块地址与内存地址匹配信号及上位机触发使能信号，输出端连接调试模块对内存使能信号；其状态判断电路中，第二或门的两输入端连接调试模块以获取读写信号，第三与门的两输入端分别与第一或门及第二或门的输出端相连，输出端输出系统忙信号。
主权项：1.RISCV系统内存的调试电路，包括内存、调试模块及通讯接口，其特征在于：所述调试模块包括内核使能内存电路、调试模块使能内存电路及状态判断电路；所述内核使能内存电路包括第一或门及第一与门，所述第一或门的两输入端分别连接RISCV内核的读写信号，所述第一与门的两输入端分别连接所述第一或门的输出端及所述RISCV内核地址与内存地址匹配信号，输出端连接所述RISCV内核对内存使能信号；所述调试模块使能内存电路包括第一或非门及第二与门，所述第一或非门的两输入端分别连接所述RISCV内核以获取读写信号，所述第二与门的三输入端分别连接所述第一或非门的输出端、所述调试模块地址与内存地址匹配信号及上位机的触发使能信号，输出端连接所述调试模块对内存使能信号；所述状态判断电路包括第三与门及第二或门，所述第二或门的两输入端连接调试模块以获取读写信号，所述第三与门的两输入端分别与所述第一或门及所述第二或门的输出端相连，输出端输出系统忙信号。
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百度查询： 厦门芯矽望集成电路技术有限公司 RISCV系统内存的调试电路
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