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申请/专利权人：湖南大学
摘要：本发明公开了一种PUF和TRNG一体化输出方法、电路及FPGA，将多个激励数据输入至仲裁器PUF进行激励，获得激励‑响应数据；进行筛选获得第一激励数据集；配置仲裁器PUF；分别对62级PUF和32级PUF进行PUF建模，然后进行延迟差挑选，通过第二激励数据集配置仲裁器PUF；最后通过仲裁器PUF进行异或处理得到TRNG值，通过仲裁器PUF得到64级输出的PUF值。本发明实现了PUF和TRNG的真正一体化，减少了面积和资源的开销，结构简单，并且可以实现PUF和TRNG的同时输出，此外通用性好，适用于所有延迟类的PUF。
主权项：1.一种PUF和TRNG一体化输出方法，其特征在于，包括以下步骤：将多个激励数据输入至仲裁器PUF进行激励，获得64级仲裁器PUF的响应值，根据激励数据和响应值获得激励-响应数据；对激励-响应数据进行筛选，获得第一激励数据集，所述第一激励数据集中的第一激励-响应数据满足PUF的稳定性、唯一性和均匀性；通过第一激励数据集配置仲裁器PUF，获得62级仲裁器PUF的响应值和32级仲裁器PUF的响应值；通过逻辑回归算法分别对62级仲裁器PUF的响应值和32级仲裁器PUF的响应值进行PUF建模，然后进行延迟差挑选，获取与62级和32级仲裁器PUF延迟差最接近的激励-响应数据，得到第二激励数据集；通过第二激励数据集配置仲裁器PUF；通过仲裁器PUF进行异或处理得到TRNG值，通过仲裁器PUF得到64级输出的PUF值。
全文数据：
权利要求：
百度查询： 湖南大学 PUF和TRNG一体化输出方法、电路及FPGA
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