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用于减少超低延迟应用的最坏情况延迟的机制 

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申请/专利权人:英特尔公司

摘要:本公开描述与延迟减少相关的系统、方法和装置。装置可在接入点AP多链路装置MLD和非APMLD之间建立多个链路。装置可编码帧,该帧用于在APMLD的第一AP和非APMLD的第一STA之间在多个链路中的第一链路上传输。装置可使用干扰抑制信号识别在非APMLD的第二STA处接收的指示。装置可根据该指示使得该帧在第一链路上的传输停止。装置可识别从第一AP接收的在第一链路上的第二帧。装置可使得第一帧在第一链路上的传输恢复。

主权项:1.一种装置,所述装置用于具有多个站装置STA的非接入点AP多链路装置MLD,所述装置包括耦接到存储器的处理电路,所述处理电路被配置为:借助APMLD建立多链路操作,其中,所述APMLD包括所述APMLD内的多个AP;在所述APMLD和所述非APMLD之间设置多个链路,其中所述多链路操作在所述多个链路的每个链路上将所述APMLD的相应AP与所述非APMLD的相应装置连接;编码帧,所述帧用于在所述APMLD的第一AP和所述非APMLD的第一STA之间在所述多个链路中的第一链路上传输;使用干扰抑制信号识别在所述非APMLD的第二STA处接收的指示;根据所述指示使得所述帧在所述第一链路上的所述传输停止;识别从所述第一AP接收的在所述第一链路上的第二帧;并且使得所述第一帧在所述第一链路上的所述传输恢复。

全文数据:

权利要求:

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