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用于偶数阶INL消除和电源噪声/干扰抑制的差分数字时间转换器 

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申请/专利权人:高通股份有限公司

摘要:根据某些方面,提供了一种在锁相环路PLL中进行量化噪声消除的方法。该PLL包括相位检测器,该相位检测器具有被配置为接收参考信号的第一输入端和被配置为接收反馈信号的第二输入端。该方法包括:将该参考信号延迟第一时间延迟,将该反馈信号延迟第二时间延迟,接收Δ‑∑调制器DSM误差信号,以及基于该DSM误差信号在相反方向上调整该第一时间延迟和该第二时间延迟。

主权项:1.一种系统,所述系统包括:相位检测器;第一数字时间转换器DTC,所述第一数字时间转换器DTC具有信号输入端、控制输入端以及输出端,其中所述第一DTC的所述信号输入端被配置为接收参考信号,并且所述第一DTC的所述输出端耦合到所述相位检测器的第一输入端;第二DTC,所述第二DTC具有信号输入端、控制输入端以及输出端,其中所述第二DTC的所述信号输入端被配置为接收反馈信号,并且所述第二DTC的所述输出端耦合到所述相位检测器的第二输入端;和解码器,所述解码器具有输入端、第一输出端以及第二输出端,其中所述解码器的所述输入端被配置为接收Δ-∑调制器DSM误差信号,所述解码器的所述第一输出端耦合到所述第一DTC的所述控制输入端,并且所述解码器的所述第二输出端耦合到所述第二DTC的所述控制输入端。

全文数据:

权利要求:

百度查询: 高通股份有限公司 用于偶数阶INL消除和电源噪声/干扰抑制的差分数字时间转换器

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