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申请/专利权人：福州派利德电子科技有限公司

摘要：本实用新型提供了一种基于FPGA的可重构PCI输入输出卡，PCI模块、FPGA模块以及connector模块；PCI模块与FPGA模块通过PCI总线连接，FPGA模块与connector模块之间设置有具有电平转换功能的双向缓冲器，该双向缓冲器的SB端与connector模块相连，该双向缓冲器的SA端和OE端与FPGA模块相连；应用本技术方案可实现IO卡的灵活且可重构的功能。

主权项：1.一种基于FPGA的可重构PCI输入输出卡，其特征在于，包括PCI模块、FPGA模块以及connector模块；PCI模块与FPGA模块通过PCI总线连接，FPGA模块与connector模块之间设置有具有电平转换功能的双向缓冲器，该双向缓冲器的SB端与connector模块相连，该双向缓冲器的SA端和OE端与FPGA模块相连；FPGA模块内部包括的电路有：CTRL_UNIT、IRAM、ORAM、第一选择器IMUX、第二选择器OMUX、DPU和IOUT；CTRL_UNIT是FPGA模块的核心控制模块，CTRL_UNIT与PCI模块相连;EXTI_REG是外部中断寄存器，EXTI_REG被置于CTRL_UNIT内部，与IMUX的输出端之一相连；IRAM包括IRAM32、IRAM16、IRAM8，所述IRAM32、IRAM16、IRAM8分别是32、16、8位的RAM单元；ORAM包括ORAM32、ORAM16、ORAM8，所述ORAM32、ORAM16、ORAM8是32、16、8位的RAM单元；第一选择器IMUX的选择端子与CTRL_UNIT相连，输出信号与EXTI_REG、IRAM32、IRAM16、IRAM8相连，输入信号DI与IOUTn相连；第二选择器OMUX的选择端子与CTRL_UNIT相连，输入信号与ORAM32、ORAM16、ORAM8相连，输出信号DO与DPU相连；DPU为数据处理单元，数据处理单元的数据输入端口与第二选择器OMUX相连，输出信号与IOUTn相连，另外数据处理单元的配置端口与CTRL_UNIT相连；IOUT0为带锁存功能的双向数据端口，双向数据端口的115端子与BUF0的SA相连，双向数据端口的112端子与DPU相连，双向数据端口的114端子是数据方向控制端口与CTRL_UNIT相连；BUF0为SB与IO卡的输出连接器相连，其DIR端与FPGA模块相连，在FPGA模块内部连接CTRL_UNIT,BUF0的OE端也与FPGA模块相连，在FPGA模块内部连接CTRL_UNIT。

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