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申请/专利权人：瓴科微(上海)集成电路有限责任公司

摘要：本发明提供了一种抗干扰的LVDS共模反馈电路，包括LVDS单元和共模反馈单元，其中共模反馈单元根据第一输入信号Dinp和第一差分信号Voutp，检测第三开关管M3的开启时间，产生第三开关管M3开启时间指示信号Delayp2，根据第二输入信号Dinn和第二差分信号Voutn，检测第一开关管M1的开启时间，产生第一开关管M1开启时间指示信号Delayn2。本发明能够实现共模电压反馈调节，避免共模电压偏移和波动，同时防止外部噪声和干扰耦合到芯片内部传导。

主权项：1.一种抗干扰的LVDS共模反馈电路，包括LVDS单元和共模反馈单元，其特征在于，所述LVDS单元具体包括：第一开关管M1的漏极连接第三开关管M3的漏极和第五开关管M5的漏极，第一开关管M1的衬底接地，第一开关管M1的源极连接第二开关管M2的漏极，并作为第二差分输出端，产生第二差分信号Voutn，第一开关管M1的栅极连接第二输入信号Dinn；第二开关管M2的衬底接地，第二开关管M2的源极连接第四开关管M4的源极和第六开关管M6的漏极，第二开关管M2的栅极连接第一输入信号Dinp；第三开关管M3的衬底接地，第三开关管M3的源极连接第四开关管M4的漏极，并作为第一差分输出端，产生第一差分信号Voutp，第三开关管M3的栅极连接第一输入信号Dinp；第四开关管M4的衬底接地，第四开关管M4的栅极连接第二输入信号Dinn；第五开关管M5的漏极连接电源电压VDD，第五开关管M5的栅极连接第一开关管M1开启时间指示信号Delayn2；第六开关管M6的源极接地，第六开关管M6的栅极连接第三开关管M3开启时间指示信号Delayp2；所述共模反馈单元具体包括：第一异或门，接收第一输入信号Dinp和第一差分信号Voutp，产生第三开关管M3的开启时间信号Delayp；第一电阻R1的第一端连接第三开关管M3的开启时间信号Delayp，第一电阻R1的第二端连接第一电容C1的第一端和第二电阻R2的第一端；第一电容C1的第二端接地；第二电阻R2的第二端连接第三电阻R3的第二端、第四电阻R4的第一端和第一误差放大器A1的同相输入端；第三电阻R3的第一端连接第一直流偏置信号Vdcp；第四电阻R4的第二端接地；第一误差放大器A1的反相输入端连接第五电阻R5的第一端和第六电阻R6的第一端，第五电阻R5的第二端接地，第一误差放大器A1的输出端连接第六电阻R6的第二端，产生第三开关管M3开启时间指示信号Delayp2；所述共模反馈单元还包括：第二异或门，接收第二输入信号Dinn和第二差分信号Voutn，产生第一开关管M1的开启时间信号Delayn；第七电阻R7的第一端连接第一开关管M1的开启时间信号Delayn，第七电阻R7的第二端连接第二电容C2的第一端和第八电阻R8的第一端；第二电容C2的第二端接地；第八电阻R8的第二端连接第九电阻R9的第二端、第十电阻R10的第一端和第二误差放大器A2的同相输入端；第九电阻R9的第一端连接第二直流偏置信号Vdcn；第十电阻R10的第二端接地；第二误差放大器A2的反相输入端连接第十一电阻R11的第一端和第十二电阻R12的第一端，第十一电阻R11的第二端接地，第二误差放大器A2的输出端连接第十二电阻R12的第二端，产生第一开关管M1开启时间指示信号Delayn2；所述共模反馈单元根据第一输入信号Dinp和第一差分信号Voutp，检测第三开关管M3的开启时间，产生第三开关管M3开启时间指示信号Delayp2，根据第二输入信号Dinn和第二差分信号Voutn，检测第一开关管M1的开启时间，产生第一开关管M1开启时间指示信号Delayn2。

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