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申请/专利权人：成都玖锦科技有限公司
摘要：本发明涉及一种基于FPGA实现的数字示波器内部校准源设计方法，属于测试测量技术领域，包括：步骤一、在示波器内预设一包括FPGA、直流源模块、正弦校准源模块和快沿源模块的校准源装置，其中正弦校准源模块内部包括一数控衰减器，用于控制信号增益；步骤二、FPGA控制直流模块、正弦校准源模块和快沿源模块进行初始化，初始化各模块通道控制，输出默认校准信号；步骤三、接收示波器上位机发送的控制信号，根据控制信号计算相应的控制值，并通过FPGA进行重配置，使得直流源模块或正弦校准源模块或快沿源模块输出所需校准信号的类型、频率和增益。本发明输出的校准源类型多样，且体积小方便集成到示波器整机中作为整机校准源。
主权项：1.一种基于FPGA实现的数字示波器内部校准源设计方法，其特征在于：所述设计方法包括：步骤一、在示波器内预设一包括FPGA、直流源模块、正弦校准源模块和快沿源模块的校准源装置，其中正弦校准源模块内部包括一数控衰减器，用于控制信号增益；步骤二、FPGA控制直流模块、正弦校准源模块和快沿源模块进行初始化，初始化各模块通道控制，输出默认校准信号；步骤三、接收示波器上位机发送的控制信号，根据控制信号计算相应的控制值，并通过FPGA进行重配置，使得直流源模块或正弦校准源模块或快沿源模块输出所需校准信号的类型、频率和增益；所述步骤三中正弦校准源模块输出所需校准信号的类型、频率和增益包括：B1、根据所需输出正弦校准信号频率，设计PLL芯片输出通路选择策略，且必须满足要求和，其中，为输出正弦校准信号频率，为是否开启VCO倍频，，分别为PLL芯片的最大、最小VCO频率值，divider为输出通道分频比，表示4组分频值；B2、根据所选输出通道，根据计算PLL芯片所需的VCO频率值和VCO反馈环路参数，并根据输出正弦校准信号频率与和的关系选择输出通路，再计算VCO回路整数倍分频N值和小数倍分频NUM值，其中，为鉴相器频率；B3、根据B2步骤的计算值重新配置PLL芯片的寄存器，再根据所需信号类型和信号增益，控制数控衰减器以切换相应的输出通道。
全文数据：
权利要求：
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