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申请/专利权人：沐曦科技(北京)有限公司

摘要：本申请涉及数据处理技术领域，特别是涉及一种用于部分写入的数据处理系统，系统包括：内存、指令队列缓冲器、数据库、处理器和存储有计算机程序的存储器，计算机程序被处理器执行时，实现以下步骤：将目标原子操作拆分为读指令和写指令后，与待执行指令存入指令队列缓冲器中进行重排序，得到重排序结果，其中，读指令在写指令之前，且当存在访问目标地址的待执行指令时，读指令、写指令以及二者之间的待执行指令的位宽之和小于阈值，按照重排序结果执行，得到数据处理结果，可知，将目标原子操作拆分为读指令和写指令，使得读指令和写指令之间可以插入其他待执行指令，无需直接进行读写指令切换，减少读写指令切换次数，有效提高内存效率。

主权项：1.一种用于部分写入的数据处理系统，其特征在于，所述系统包括：内存、指令队列缓冲器、数据库、处理器和存储有计算机程序的存储器，其中，所述数据库中包括待执行的目标原子操作和N个待执行指令，所述目标原子操作包括对目标地址A所对应原始数据D1的读取操作，对D1的改写操作和将改写后的目标数据D2写入A的操作，当所述计算机程序被处理器执行时，实现以下步骤：S101，将所述目标原子操作拆分为读指令RA和写指令WA，RA为对目标地址A所对应原始数据D1的读取操作对应的指令，WA为将改写后的目标数据D2写入A的操作对应的指令；S102，将RA、WA和所述N个待执行指令分别作为目标指令，存入所述指令队列缓冲器；S103，在所述指令队列缓冲器中，对所有目标指令进行重排序，得到重排序结果，其中，在所述重排序结果中，RA在WA之前，且RA和WA之间包含M个待执行指令，N≥M≥0，当所述N个待执行指令中存在访问A的待执行指令时，所述重排序结果满足第一预设条件，所述第一预设条件为RA、WA和所述M个待执行指令分别对应的位宽之和小于第一预设位宽阈值，当所述N个待执行指令中存在访问A的待执行指令时，所述重排序结果还满足第二预设条件，所述第二预设条件为所有访问A的待执行指令均在WA之后；S104，根据所述重排序结果，在所述内存中逐一执行所述目标指令，得到数据处理结果，所述数据处理结果包括对D1进行改写后得到的D2。

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