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申请/专利权人：电子科技大学

摘要：本发明涉及一种基于实时边沿单点插值的低抖动码型波形合成装置。该装置包括上位机、数据存储模块、合成控制模块、误差计算模块、边沿样点计算模块、幅度转换模块、样点累加模块、输出控制模块、数模转换器以及低通滤波器。该装置在固定时钟的前提下，根据每个码元的时间、幅度和脉宽之间的映射关系，采用实时计算的方法在信号波形的边沿增加一个采样点。本发明在固定时钟条件下，通过在码型波形边沿插入一个样点，实现对码元脉宽的精确控制，降低了抖动大小；合成码型波形的分辨率不再受限于数模转换器的采样时间间隔，提高了输出分辨率；通过在实时计算样点数据，避免了对大量波形样点进行存储，从而降低了对存储资源的消耗。

主权项：1.一种基于实时边沿单点插值的低抖动码型波形合成装置，其特征在于，包括上位机、数据存储模块、合成控制模块、误差计算模块、边沿样点计算模块、幅度转换模块、样点累加模块、输出控制模块、数模转换器、低通滤波器；其中，所述上位机产生整个合成装置的控制命令，将用户设定的码型序列数据P[k]，k为码型序列位置，k＝0,1,2…，按照通信协议要求，发送到数据存储模块和合成控制模块；合成控制模块接收上位机的输出数据，并对数据存储模块、幅度转换模块、误差计算模块、边沿计算模块、样点累加模块、输出控制模块、数模转换器模块进行控制；数据存储模块接收并存储上位机发送的码型数据P[k]，在合成控制模块作用下根据码型序列位置k输出对应的码型数据P[k]到误差计算模块和幅度计算模块；误差计算模块根据输出样点位置n与码型序列位置k之间的关系，计算边沿整数样点位置ninteger_k和误差大小nfrac_k，并将其输出给边沿样点计算模块；其中，误差计算模块的计算过程如下： ΔTk＝nfrac_k*Ts其中，nideal_k为理想边沿位置，fs为采样率，f为码型速率，α为采样率fs和码型速率f的比值；floor表示向下取整；nfrac_k用两个整数ek和M相除表示，用于后续边沿插值样点值计算；ΔTk是误差nfrac_k对应的时间大小，Ts是数模转换器的采样时间间隔；边沿样点计算模块在样点位置n处于边沿插值样点位置时，根据误差大小nfrac_k和样点所处电平样点值计算边沿插值点值Vedge_k，输出结果送到输出控制模块；其中，边沿样点计算模块的计算过程如下：nedge_k＝ninteger_k,当2ek≤Mnedge_k＝ninteger_k+1,当2ekM 其中，Vedge_k为第k个序列的边沿样点位置，Vref为序列对应的电平判决参考值，Vlevel_k和Vlevel_k+1分别是第k个码元和k+1个码元对应电平样点值，Vref、Vlevel_k、Vlevel_k+1均由上位机设定；幅度转换模块，根据码型数据序列位置k所处电平，将码型数据P[k]转换为电平样点值Vlevel_k输出给输出控制模块；样点累加器模块进行计数使能控制和复位控制，对样点位置n计数，并输出n值到输出控制模块；输出控制模块根据采样点位置n，输出为样点位置n对应的样点值Vn，Vn如下公式描述： 数模转换器，将波形样点数据进行数字模拟转换，将转换后的模拟信号送入低通滤波器；低通滤波器，用于对数模转换器输出的模拟信号进行低通滤波，滤除镜像杂散信号，输出码型波形。

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百度查询： 电子科技大学 一种基于实时边沿单点插值的低抖动码型波形合成装置