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申请/专利权人：意法半导体国际公司
摘要：本公开涉及低时延复位同步器电路。第一锁存电路具有由复位信号控制的复位功能，并且被配置为响应于时钟信号的第一边沿锁存逻辑状态以生成第一输出信号。第二锁存电路具有由该复位信号控制的复位功能，并且被配置为响应于该时钟信号的第二边沿锁存逻辑状态以生成第二输出信号。第一边沿和第二边沿是相对的边沿。组合逻辑电路将第一输出信号和第二输出信号逻辑组合以生成逻辑输出信号。第三锁存电路具有由该复位信号控制的复位功能，并且被配置为响应于该时钟信号的第二边沿锁存逻辑输出信号以生成复位同步控制信号。
主权项：1.一种复位同步电路，包括：第一锁存电路，具有由复位信号控制的复位功能，并且被配置为响应于时钟信号的第一边沿锁存逻辑状态以生成第一输出信号；第二锁存电路，具有由所述复位信号控制的复位功能，并且被配置为响应于所述时钟信号的第二边沿锁存逻辑状态以生成第二输出信号；其中第一边沿和第二边沿是相对的边沿；组合逻辑电路，被配置为对第一输出信号和第二输出信号进行逻辑组合以生成逻辑输出信号；以及第三锁存电路，具有由所述复位信号控制的复位功能，并且被配置为响应于所述时钟信号的所述第二边沿锁存所述逻辑输出信号以生成复位同步控制信号。
全文数据：
权利要求：
百度查询： 意法半导体国际公司 低时延复位同步器电路
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