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申请/专利权人：无锡中微爱芯电子有限公司

申请日：2024-12-31

公开（公告）日：2025-02-07

公开（公告）号：CN119396269A

专利技术分类：....减少功率消耗的手段，措施或步骤[2019.01]

专利摘要：本发明属于微处理器技术领域，特别涉及一种集成于MCU的低功耗唤醒电路。包括：触发器DQ1~DQ6、非门NOT1~NOT5、与门AND1~AND3、三态门TS1、异或门XOR1、比较器CMP1和选择器MUX1；其中，触发器DQ1~DQ4的D端、以及非门NOT1~NOT4的输出端均接入数据总线，触发器DQ1的CLK端接入P0寄存器的写使能信号，触发器DQ1的Q端接入三态门TS1的输入端，三态门TS1的输出端接入端口，触发器DQ2的CLK端接入P0IO寄存器的写使能信号，触发器DQ2的QN端和非门NOT1的输入端接入三态门TS1的控制端，非门NOT1的控制端接入P0IO寄存器的读使能信号。本发明通过电容充放电，使得端口电平从高到低的变化，从而产生唤醒信号。无需外部设备或内部程序产生周期性的唤醒信号，减小整机系统功耗。

专利权项：1.一种集成于MCU的低功耗唤醒电路，其特征在于，包括：触发器DQ1~DQ6、非门NOT1~NOT5、与门AND1~AND3、三态门TS1、异或门XOR1、比较器CMP1和选择器MUX1；其中，触发器DQ1~DQ4的D端、以及非门NOT1~NOT4的输出端均接入数据总线，触发器DQ1的CLK端接入P0寄存器的写使能信号，触发器DQ1的Q端接入三态门TS1的输入端，三态门TS1的输出端接入MCU的IO端口，触发器DQ2的CLK端接入P0IO寄存器的写使能信号，触发器DQ2的QN端和非门NOT1的输入端接入三态门TS1的控制端，非门NOT1的控制端接入P0IO寄存器的读使能信号，非门NOT2的控制端接入P0寄存器的读使能信号，触发器DQ3的CLK端接入IE0寄存器的写使能信号，触发器DQ3的QN端接入非门NOT3的输入端，非门NOT3的控制端接入IE0寄存器的读使能信号，触发器DQ4的CLK端接入P0AN寄存器的写使能信号，触发器DQ4的Q端接入非门NOT5的输入端，触发器DQ4的QN端接入非门NOT4的输入端，非门NOT4的控制端接入P0AN寄存器的读使能信号，与门AND1的三个输入端分别接入触发器DQ1和触发器DQ3的Q端、以及异或门XOR1的输出端，与门AND1的输出端输出电平变化中断唤醒信号，异或门XOR1的两个输入端分别接入触发器DQ5和触发器DQ6的Q端，触发器DQ5的Q端接入非门NOT2的输入端，触发器DQ5的EN端接入CLK3，触发器DQ6的EN端接入P0寄存器的读使能信号，非门NOT5和选择器MUX1的输出端分别接入与门AND2的两个输入端，与门AND2的输出端接入触发器DQ5和触发器DQ6的D端，选择器MUX1的两个输入端分别接入比较器CMP1的反相输入端和输出端，选择器MUX1的控制端接入超低功耗唤醒使能信号ULPWKE和超低功耗电流IULP的第一端，比较器CMP1的同相输入端接入DAC模块输出电压VIL，比较器CMP1的反相输入端接入三态门TS1的输出端和超低功耗电流IULP的第二端，超低功耗电流IULP的接地端接地。

百度查询： 无锡中微爱芯电子有限公司 一种集成于MCU的低功耗唤醒电路