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龙图腾网恭喜成都橙峰科技有限公司申请的专利一种归一化分层最小和LDPC译码器的FPGA实现方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116896391B 。

龙图腾网通过国家知识产权局官网在2025-04-04发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310715691.2，技术领域涉及：H03M13/11；该发明授权一种归一化分层最小和LDPC译码器的FPGA实现方法是由姚静;杜念通;尤喜成设计研发完成，并于2023-06-16向国家知识产权局提交的专利申请。

本一种归一化分层最小和LDPC译码器的FPGA实现方法在说明书摘要公布了：本发明涉及一种归一化分层最小和LDPC译码器的FPGA实现方法，该方法包括：S1、根据扩展因子大小获取i个变量节点值NV和j个校验节点值CV，再重组成一个有效待译码信息QLLR；S2、根据归一化分层算法将所述有效待译码信息QLLR所在位置分成n层；S3、采用流水线方式根据在第j层位置所涉及有效待译码来更新第j+1层的APP值，直至译码结束。因此，本发明流水线译码通过解决层与层之间信息丢失等问题，很大程度上缩短了译码时延，提高了译码吞吐量。

本发明授权一种归一化分层最小和LDPC译码器的FPGA实现方法在权利要求书中公布了：1.一种归一化分层最小和LDPC译码器的FPGA实现方法，其特征在于：S1、根据扩展因子大小获取i个变量节点值NV和j个校验节点值CV，重组成一个有效 其中，每个QLLR的大小为64*6bits；S2、根据归一化分层算法将所述有效待译码信息矩阵QLLR所在位置分成n层，n大于等于j；S3、采用流水线方式根据在第j层位置所涉及有效待译码来更新第j+1层的APP值，直至译码结束；所述第j+1层的APP值的计算公式：为第j层位置所涉及有效待译码进行循环移位后得到新的有效待译码；Δi为第j+1层和第j层之间丢失信息大小；为第j层的校验节点大小；所述步骤S3的具体步骤包括：假设所涉及有效待译码LLRi所处位置为nodeseli，j，nodeseli，j的信息大小为和nodeseli，j+1的信息大小为nodeseli，j对应的校验信息为和nodeseli，j+1对应的校验信息为具体步骤如下：S31、将第j层位置所涉及有效待译码进行循环移位后得到新的有效待译码S32、根据double指示信号来判断nodeseli，j与nodeseli，j+1是否存在同时出现的点；S33、若是，则需计算第j层和第j+1层之间丢失信息大小Δi,再将得到新的有效待译码减去nodeseli，j对应的校验信息形成第一计算结果；若否，则将得到新的有效待译码减去nodeseli，j对应的校验信息形成第二计算结果；其中Δi大小等于第j+1层的校验节点值减去第j层的校验节点值S34、根据归一化分层最小和算法计算变量节点传递给校验节点的信息最小值V2C2min并乘alpha值，形成第三计算结果；S35、将上述第一计算结果或第二计算结果与第三计算结果相加，得到最终计算结果后更新第j+1层的APP值；S36、重复上述步骤S31至步骤S35，直至每层位置所涉及有效待译码的译码结束。

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