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一种RMII与多个CPRI之间的数据传输方法 

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申请/专利权人:三维通信股份有限公司

摘要:本发明提供了一种RMII与多个CPRI之间的数据传输方法,近端机接口面板上设置一个网口和四个光纤口,网口与数字版的ARM连接,ARM通过RMII与FPGA连接,FPGA有四个CPRI与A、B、C和D四个光口连接;FPGA内部分为6个功能模块:ARM侧数据缓存模块、A光口侧数据缓存模块、B光口侧数据缓存模块、C光口侧数据缓存模块、D光口侧数据缓存模块和数据交换模块,各个数据缓存模块之间通过数据交换模块传输数据;数据流向为:RMII到CPRI,CPRI到RMII,CPRI到CPRI。本发明有益的效果是:提供了一种基于数字光纤直放站中通过FPGA实现RMII与多个CPRI之间的数据传输技术。该技术可以有效的解决RMII与多个CPRI之间数据的顺利的传输。

主权项:一种RMII与多个CPRI之间的数据传输方法,其特征在于:近端机接口面板上设置一个网口和四个光纤口,网口与数字版的ARM连接,ARM通过RMII与FPGA连接,FPGA有四个CPRI与A、B、C和D四个光口连接;FPGA内部分为6个功能模块:ARM侧数据缓存模块、A光口侧数据缓存模块、B光口侧数据缓存模块、C光口侧数据缓存模块、D光口侧数据缓存模块和数据交换模块,各个数据缓存模块之间通过数据交换模块传输数据;数据流向为:RMII到CPRI,CPRI到RMII,CPRI到CPRI;所述ARM侧数据缓存模块用于实现了从ARM发送过来的以太网数据包的缓存、从交换模块发送给RAM的数据包的缓存,实现RMII接口的数据的接收和发送,并完成数据流阻塞时阻止ARM再发送数据包;从RMII到数据交换模块的数据处理都是整包处理,当RMII_TX_EN使能,数据输入到数据RAM0,同时地址RAM0保存当前包DA的第一个字节;完成一整个包的存储之后,告诉交换模块本缓存模块能够读取,当数据RAM0空间小于2KByte,并完成了整包的缓存,那么则认为数据有阻塞,那么将拉高RMII_CRS_DV;其中地址RAM0深度为64,表示数据RAM0最多能够缓存64个以太网包;如果缓存包超过32个,则认为数据有阻塞,那么将拉高RMII_CRS_DV;所述的A光口侧数据缓存模块、B光口侧数据缓存模块、C光口侧数据缓存模块和D光口侧数据缓存模块,用于从CPRI发送过来的以太网数据包的缓存、从交换模块发送给CPRI的数据包的缓存,实现CPRI接口的数据的接收和发送;从CPRI到交换模块的数据处理都是整包处理,当CPRI数据输入到数据RAM0,同时地址RAM0保存当前包DA的第一个字节,完成一整个包的存储之后,告诉交换模块本缓存模块能够读取;其中,RMII是指简化媒体独立接口,CPRI是指通用公共无线接口,DA是指目的地址。

全文数据:

权利要求:

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