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申请/专利权人：进迭时空(珠海)科技有限公司

摘要：本发明公开一种基于AXI总线的信号压缩传输的方法、装置及系统，包括如下步骤：发送设备在AXI总线的发送端插入发送先进先出FIFO通道和发送FSM电路，将AXI总线支持的传输数据的信号数量进行压缩；接收设备在AXI总线的接收端插入接收先进先出FIFO通道和接收FSM电路，还原成原始的AXI总线支持的传输数据。本发明通过将大量的AXI总线信号通过FIFOFSM电路转成IO数量可控的FPGA间互联信号，传送到另外一颗FPGA，然后在接收端恢复成AXI信号，大大减少FPGA之间的互联信号数量，且不影响FPGA的AXI的频率。

主权项：1.一种基于AXI总线的信号压缩传输的方法，其特征在于包括如下步骤：发送设备在AXI总线的发送端插入发送先进先出FIFO通道和发送FSM电路，将AXI总线支持的传输数据的信号数量进行压缩；接收设备在AXI总线的接收端插入接收先进先出FIFO通道和接收FSM电路，还原成原始的AXI总线支持的传输数据；所述发送设备为主设备，所述接收设备为从设备，所述先进先出FIFO通道为同步先进先出FIFO通道，所述AXI总线支持的传输数据包括写地址信息、写数据信息和读地址信息，分别接入不同的所述同步先进先出FIFO通道；或者所述发送设备为从设备，所述接收设备为主设备，所述AXI总线支持的传输数据包括写响应信息和读数据信息，分别接入不同的所述同步先进先出FIFO通道；所述信号压缩传输的方法用于带有valid和ready的AXIACE总线设备间压缩互联；在由主设备向从设备通过写数据传输通道写数据时，转变为主设备的valid与ready信号与TXFIFO握手，TXFSMtxch_ready的上电初始状态为为高电平，当主设备的txdata快填满TXFIFO时，txch_ready变为低电平，拉住主设备的写数据channel，不允许主设备继续写数：A、上电复位后，TXFSM为EMPTY状态；B、当TXFSM处于EMPTY状态：当divalid有效，则TXFSM转变为FULL状态；如果divalid无效，则TXFSM保持EMPTY状态；C、当TXFSM处于FULL状态：当doready有效，则TXFSM转变为TRANS状态；如果doready无效，则TXFSM保持FULL状态；D、当TXFSM处于TRANS状态：当fifo_empty有效，则TXFSM转变为EMPTY状态；如果fifo_empty无效，则TXFSM保持TRANS状态；RXFSM的ready信号上电默认为高电平，允许TXFIFO把数据发送给RXFIFO，当RXFIFO快满时，RXFSM的ready信号拉低，阻止TXFIFO继续向RXFIFO写数据：A、上电复位后，RXFSM为EMPTY状态；B、当RXFSM处于EMPTY状态：当divalid有效，则RXFSM转变为TRANS状态；如果divalid无效，则RXFSM保持EMPTY状态；C、当RXFSM处于TRANS状态：当fifo_full有效，则RXFSM转变为FULL状态；如果fifo_full无效，则RXFSM保持TRANS状态；D、当RXFSM处于FULL状态：当doready有效，则RXFSM转变为EMPTY状态；如果doready无效，则RXFSM保持FULL状态。

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