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申请/专利权人：香港应用科技研究院有限公司

摘要：一种两点调制锁相环PLL具有双输入压控振荡器VCO。数字数据调制信号与载波结合，输入到反馈分频器。数据调制信号也输入到偏移数模转换器DAC，以产生模拟电压到VCO的第二个输入端。通过VCO的环路路径比通过VCO的DAC路径有更高的增益，其线性度更好。校准单元对VCO输出进行分频，并对脉冲进行计数。偏移DAC有数据输入和增益输入。在校准期间，将DAC的数据输入设置为最小值，然后对VCO输出脉冲进行计数，并对输入到DAC的两个增益值重复上述操作。从这四个计数中，KDAC计算器会计算出校准增益值，并将其施加于偏移DAC的增益输入。

主权项：1.一种可调增益合成器，包括：相位检测器，其用于比较参考时钟与反馈时钟；电荷泵，其由所述相位检测器激活；环路滤波器，其由所述电荷泵充电和放电；电压可控振荡器VCO，其有一个环路输入和一个调制输入，所述环路输入用于确定VCO输出的频率，所述调制输入用于调制所述VCO输出的频率；开关，其用于在正常模式期间将所述环路滤波器连接到所述环路输入，并在校准模式期间断开所述环路滤波器并向所述环路输入施加一个参考电压，其中在校准模式期间，所述可调增益合成器以开环模式工作；反馈分频器，其用于将所述VCO输出除以一个除数以产生所述反馈时钟；校准单元，其具有脉冲计数器，用于接收所述VCO输出并产生一个时间段的脉冲计数；数模转换器DAC，其接收调制输入和增益校准输入，所述调制输入接收数据调制信号，所述DAC产生信号到所述VCO的调制输入；校准单元中的控制器，其用于将所述DAC的所述增益校准输入强制设置为第一DAC增益值，并在所述脉冲计数器在一个时间段内产生第一脉冲计数的同时将所述数据调制信号强制设置为最大值，并在所述脉冲计数器在所述时间段产生第二脉冲计数的同时将所述数据调制信号强制设置为最小值；其中，所述校准单元中的控制器还将所述DAC的所述增益校准输入强制设置为第二DAC增益值，并在所述脉冲计数器在所述时间段内产生第三脉冲计数的同时将所述数据调制信号强制设置为最大值，并在所述脉冲计数器在所述时间段内产生第四脉冲计数的同时，将所述数据调制信号强制设置为最小值；以及KDAC计算器，其从第一、第二、第三和第四脉冲计数产生校准DAC增益值；其中，在正常模式期间，将所述校准DAC增益值施加于所述DAC的所述增益校准输入，以通过增益补偿来调整所述VCO的所述调制输入；从而，在两个DAC增益值下的校准会产生四个脉冲计数，所述四个脉冲计数确定施加到所述DAC的所述增益校准输入的所述校准DAC增益值；其中所述KDAC计算器包括函数发生器，所述函数发生器生成所述校准DAC增益值作为所述第一、第二、第三和第四脉冲计数的函数，其中所述校准DAC增益值为:P1–2P2*[C2-C1C4-C3-C2+C1]+P3其中:C1是所述第一脉冲计数；C2是所述第二脉冲计数；C3是所述第三脉冲计数；C4是所述第四脉冲计数；FREF是所述参考时钟的参考频率，单位为赫兹；N是测量每个计数的所述时间段内的FREF的周期数；K是所述脉冲计数器的除数，其中K等于或大于1；其中，P1、P2和P3是由FREF、N和K确定的参数，使得2*K*FREFN是2的幂。

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