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申请/专利权人：核芯互联科技(青岛)有限公司
摘要：本申请提供的差分时钟信号驱动电路，涉及电路领域。该差分时钟信号驱动电路包括驱动电路和低功耗高速电流控制逻辑电路，驱动电路与低功耗高速电流控制逻辑电路连接；驱动电路，包括多个使能端以及多对差分信号传输通路，多个使能端与多对差分信号传输通路一一对应，多对差分信号传输通路中的至少一对差分信号传输通路，基于相应使能端的控制，向低功耗高速电流控制逻辑电路输出差分驱动信号；低功耗高速电流控制逻辑电路，包括并联设置的多组晶体管，多组晶体管中的至少一组晶体管，基于差分驱动信号的控制导通，以生成差分时钟信号。实施本申请提供的技术方案，可以实现同一个LP‑HCSL匹配多种输出阻抗的场景，提高了LP‑HCSL的灵活性。
主权项：1.一种差分时钟信号驱动电路，其特征在于，包括驱动电路和低功耗高速电流控制逻辑电路，所述驱动电路与所述低功耗高速电流控制逻辑电路连接；所述驱动电路，包括多个使能端以及多对差分信号传输通路，所述多个使能端与所述多对差分信号传输通路一一对应，所述多对差分信号传输通路中的至少一对差分信号传输通路，基于相应使能端的控制，向所述低功耗高速电流控制逻辑电路输出差分驱动信号；所述低功耗高速电流控制逻辑电路，包括并联设置的多组晶体管，所述多组晶体管中的至少一组晶体管，基于所述差分驱动信号的控制导通，以生成差分时钟信号；所述驱动电路还包括正向信号输入端和反向信号输入端，所述多对差分信号传输通路中的任意一对差分信号传输通路包括正向信号传输通路和反向信号传输通路；所述正向信号传输通路包括多个级联的第一反相器，所述多个级联的第一反相器设置于所述正向信号输入端与所述正向信号传输通路的输出端之间，其中一个所述第一反相器的控制端与所述多个使能端中的第一使能端连接；所述反向信号传输通路包括多个级联的第二反相器，所述多个级联的第二反相器设置于所述反向信号输入端与所述反向信号传输通路的输出端之间，其中一个所述第二反相器的控制端与所述第一使能端连接；所述正向信号传输通路和所述反向信号传输通路之间还设置有多个级联的第三反相器。
全文数据：
权利要求：
百度查询： 核芯互联科技(青岛)有限公司 差分时钟信号驱动电路
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