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申请/专利权人：集益威半导体(上海)有限公司
摘要：本申请涉及集成电路技术领域，公开了一种降低小数量化噪声的小数分频电路，包括：多模分频器，用于接收输入时钟并根据整数分频比序列生成分频时钟；相位选择器，用于接收与输入时钟频率相同的N相时钟信号并根据相位选择信号输出相应的时钟信号，小数分频电路根据相位选择器输出的时钟信号对分频时钟重定时并输出；调制电路，调制电路包括乘法器、差分累加调制器、第一除法器、累加器、加法器和第二除法器，其中乘法器、差分累加调制器、第一除法器和加法器依次连接，累加器的输入耦合到第一除法器的输出，输出耦合到第二除法器的输入，乘法器的放大倍数为2N，第一除法器的除数为2N，第二除法器接收频率控制字的小数部分，加法器输出整数分频比序列，第二除法器输出相位选择信号。本申请提供了一种简便的方法来提高分频器输出信号精度，降低量化噪声。
主权项：1.一种降低小数量化噪声的小数分频电路，其特征在于，包括：多模分频器，用于接收输入时钟并根据整数分频比序列生成分频时钟；相位选择器，用于接收与所述输入时钟频率相同的N相时钟信号并根据相位选择信号输出相应的时钟信号；触发器，所述触发器的数据端耦合到所述多模分频器的输出，所述触发器的时钟端耦合到所述相位选择器的输出；调制电路，所述调制电路包括乘法器、差分累加调制器、第一除法器、累加器、加法器和第二除法器，其中所述乘法器、差分累加调制器、第一除法器和加法器依次连接，所述累加器的输入耦合到所述第一除法器的输出，输出耦合到所述第二除法器的输入，所述乘法器的放大倍数为2N，所述第一除法器的除数为2N，所述第一除法器接收频率控制字的小数部分，所述加法器输出所述整数分频比序列，所述第二除法器输出所述相位选择信号。
全文数据：
权利要求：
百度查询： 集益威半导体(上海)有限公司 降低小数量化噪声的小数分频电路
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