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申请/专利权人：深存科技(无锡)有限公司
摘要：本申请公开一种基于阵列结构的高位宽向量加速器和通用处理器，涉及加速器领域，包括向量加速模块和指令模块；指令模块中缓存有编译完成的指令数据，根据时序向向量加速模块发送指令流；向量加速模块中包含L行结构相同的向量加速块，相邻行的向量加速块之间通过单向指令信号线依次级联，将指令模块送入的指令流根据时序向L行向量加速块逐行传递；L行向量加速块分别设置有至少两个数据输入出端，分别接收外部数据输入，根据传递到本行的指令执行向量加速任务和数据输出。基于改进的向量计算单元，采用阵列结构，实现了灵活可配置的高位宽向量加速器设计，且支持开源指令集，提供了高性能通用计算能力。
主权项：1.一种基于阵列结构的高位宽向量加速器，其特征在于，包括向量加速模块以及与向量加速模块通过信号线连接的指令模块；所述指令模块中缓存有编译完成的指令数据，根据时序向所述向量加速模块发送指令流；所述向量加速模块中包含L行结构相同的向量加速块，相邻行的向量加速块之间通过单向指令信号线依次级联，将指令模块送入的指令流根据时序向L行向量加速块逐行传递；L行向量加速块分别设置有至少两个数据输入出端，分别接收外部数据输入，根据传递到本行的指令执行向量加速任务和数据输出；所述向量加速块包括M行阵列设计的向量计算单元、Y组向量寄存器组、一对数据选择器和一对数据寄存器；M行向量计算单元分别与Y组向量寄存器组连接，根据指令读取寄存数据和执行向量加速运算，输出端分别连接到两个数据选择器的M个数据输入端，第二数据寄存器的输出端连接到第一数据选择器的第M+1个数据输入端，第一数据选择器的输出端连接第一数据寄存器；所述第一数据寄存器的输出端连接到第二数据选择器的第M+1个数据输入端，第二数据选择器的输出端连接第二数据寄存器；所述第一数据选择器为向量加速模块的一个数据输入出端，第二数据选择器和第二数据寄存器为向量加速模块的另一数据输入出端，分别用于将外部输入数据送入向量寄存器组，以及将选通数据输出。
全文数据：
权利要求：
百度查询： 深存科技(无锡)有限公司 基于阵列结构的高位宽向量加速器和通用处理器
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