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申请/专利权人：天津光电通信技术有限公司
摘要：本发明涉及一种使FPGAGTYbank同时接入4路时钟的电路及实现方法，电路包括本地晶振G1、FPGA芯片U1、时钟芯片U2，时钟芯片U2具备4个DPLL，FPGAGTYbank支持两路时钟输入，又基于GTYbank时钟借用特性，可将相邻GTYbank时钟输入端的时钟，作为其输入时钟，这样，FPGA芯片U1的GTYbank有4路时钟输入，可以处理4路与时钟频率相匹配的高速信号。电路简单，可同时提供4路时钟；解决了多种信号同时处理的问题，并可同时满足高速信号对同步和异步时钟的需求。
主权项：1.一种使FPGAGTYbank同时接入4路时钟的电路，包括本地晶振G1、FPGA芯片U1、时钟芯片U2，其特征在于：所述的时钟芯片U2为具备4个DPLL，支持4路输入端、4路输出端的可编程低抖动时钟芯片，本地晶振G1输出异步时钟，连接在时钟芯片U2的1路输入端，FPGA芯片U1的3个接口输出同步时钟，连接在时钟芯片U2的其余3路输入端，时钟芯片U2的4路输出端输出4路时钟，连接FPGA芯片U1的3个连续的GTYbank时钟输入接口。
全文数据：
权利要求：
百度查询： 天津光电通信技术有限公司 使FPGA GTY bank同时接入4路时钟的电路及实现方法
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