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申请/专利权人：成都旋极历通信息技术有限公司

摘要：本发明提供了一种在FPGA中实现UFS阵列控制器的方法，通过在UFS控制器与UFSHCI控制器之间增加了一个阵列管理，在FPGA中实现类似于磁盘阵列管理的多个UFSFLASH的阵列控制，UFS阵列控制器包括应用层、协议层和物理层，应用层和物理层采用分层控制，应用层包括三层用于高速数据流的记录，协议层遵循UFS标准，物理层通过M‑PHY通过采用分层查表法实现底层M‑TX以及M‑RX的编码与解码。本发明基于FPGA解决了UFSFLASH阵列的控制问题，实现了UFS大容量高速存储阵列，大幅降低了航空电子设备中存储阵列的成本。

主权项：1.一种在FPGA中实现UFS阵列控制器的方法，其特征在于，整个系统通过应用模块、OS公共UFS主机控制器驱动模块、UFS阵列控制器和UFS控制器组成，所述UFS阵列控制器通过UFS主机控制器接口与所述OS公共UFS主机控制器驱动模块连接，所述UFS阵列控制器通过UFS内部接口与所述UFS控制器连接实现UFS控制器的阵列管理；所述UFS阵列控制器包括物理层、协议层和应用层，所述物理层和应用层分层控制；所述应用层包括MMIO空间管理模块、磁盘阵列管理模块、UFS操作命令集控制管理模块、设备管理器和任务管理器，所述设备管理器、任务管理器与所述协议层的接口连接遵循UFS标准；所述MMIO空间管理模块通过MMIO接口实现数据循环队列或描述符队列的控制，所述磁盘阵列管理模块实现磁盘阵列数据与地址映射，所述UFS操作命令集控制管理模块实现若干UFS器件的数据读写控制；所述物理层M-PHY通过利用分层查表在FPGA中调用7seriesFPGASTransceiversWizard，将PWM脉冲调制、差分高电平脉冲、差分低电平脉冲、配置数据编码、8b10b编码设计到若干查找表进行映射，实现M-PHY在M-TX以及M-RX上的编码解码器；所述物理层M-PHY的第一层查找表对应M-TX框架中的8B10B，将8B10B编码表和不同状态下的10位编码与传输线的高低分别用0XXXXXXXX0b，1111111111b，0000000000b设计到不同的查找表内；所述物理层M-PHY的第二层为PWM_G1数据码流查找表，对状态下8B10B转换查表的高位地址设计一个查找表，建立不同状态对应不同高位地址的映射；所述物理层M-PHY的第三层将M-PHY的17位接口接到所述M-PHY层第二层查找表的映射，包括8B10B的直接映射、DIF-N，DIF-P，DIF-N到DIF-P跳变过程以及PWM-G1数据流按照HS-GX速率取样进行映射。

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