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申请/专利权人：京微齐力(北京)科技股份有限公司
摘要：本发明涉及一种自动调节FPGA芯片内部延时偏差的方法，包括：根据芯片工艺的特点，对FPGA可编程阵列中同构电路结构划分合适规模的block，对任一block执行，在该block中设置PVT检测模块，监测该block的工艺偏差量、电压偏差量、温度偏差量；分别计算监测到的值与相应设定值的差值；结合各差值调整给该block供电的VC产生电路的参数，来调节该block中同构电路结构的延时偏差。本发明的方法，实现了FPGA芯片内部延时一致化。
主权项：1.一种自动调节FPGA芯片内部延时偏差的方法，其特征在于，包括：根据芯片工艺的特点，对FPGA可编程阵列中同构电路结构划分合适规模的block，对任一block执行，在该block中设置PVT检测模块，监测该block内部的工艺偏差量、电压偏差量、温度偏差量；计算监测到的工艺偏差量与预定工艺值相差的值，作为工艺差值；计算监测到的电压偏差量和预定电压值相差的值，作为电压差值；计算监测到的温度偏差量和预定温度值相差的值，作为温度差值；结合工艺差值、电压差值和温度差值中的至少一个，调整给该block供电的VC产生电路的参数，以调节该block中同构电路结构的延时偏差；其中，一个所述block采用一个VC产生电路供电。
全文数据：
权利要求：
百度查询： 京微齐力(北京)科技股份有限公司 一种自动调节FPGA芯片内部延时偏差的方法
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