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申请/专利权人:无锡华普微电子有限公司
摘要:本发明涉及数据采集技术领域,具体公开了一种基于FPGA的PCI总线数据采集系统,其中,包括上位机和与上位机实现通信连接的板卡,板卡包括PCI芯片、FPGA和ADC芯片,FPGA包括本地总线接口模块、指令判断模块、缓存模块和配置模块;本地总线接口模块用于对上位机通过PCI芯片下发的指令数据进行解析得到读写请求信号;指令判断模块用于将读写请求信号下发至缓存模块,并将缓存模块中的缓存信号以及ADC芯片的采集数据反馈至本地总线接口模块;缓存模块用于缓存ADC芯片的采集数据;配置模块用于根据上位机的配置数据对ADC芯片进行配置。本发明提供的基于FPGA的PCI总线数据采集系统解决了数据采集卡与上位机实时传输数据问题。
主权项:1.一种基于FPGA的PCI总线数据采集系统,其特征在于,包括上位机和与上位机实现通信连接的板卡,所述板卡包括PCI芯片、FPGA和ADC芯片,所述PCI芯片和所述ADC芯片均与所述FPGA通信连接,所述FPGA包括本地总线接口模块、指令判断模块、缓存模块和配置模块,所述指令判断模块与所述总线接口模块通信连接,所述配置模块和所述缓存模块均与所述指令判断模块通信连接;所述本地总线接口模块用于对上位机通过PCI芯片下发的指令数据进行解析得到读写请求信号,以及将所述指令判断模块反馈的所述缓存模块中的缓存信号以及所述ADC芯片的采集数据通过所述PCI芯片上传至所述上位机;所述指令判断模块用于将所述读写请求信号下发至所述缓存模块,并将所述缓存模块中的缓存信号以及所述ADC芯片的采集数据反馈至所述本地总线接口模块;所述缓存模块用于缓存所述ADC芯片的采集数据;所述配置模块用于根据所述上位机的配置数据对所述ADC芯片进行配置;所述本地总线接口模块用于对上位机通过PCI芯片下发的指令数据进行解析得到读写请求信号,包括:所述本地总线接口模块用于将所述PCI芯片的接口配置成本地总线从模式,以及在所述PCI芯片的接口为本地从模式下按照读写时序对所述上位机下发的指令数据进行解析得到读写请求信号;所述PCI芯片的本地总线包括:本地总线请求信号、本地总线应答信号、同步时钟信号、起始有效地址信号、读写指示信号、传输结束标志信号、数据有效标志信号、数据线信号和地址线信号;所述本地总线接口模块的工作状态包括初始态、单触发写状态、突发读状态和结束态,当所述PCI芯片的本地总线满足所述起始有效地址信号等于0、读写指示信号等于1且传输结束标志信号等于1时,所述本地总线接口模块从所述初始态跳转至所述单触发写状态;当所述PCI芯片的本地总线满足所述本地总线请求信号等于1且本地总线应答信号等于0时,所述本地总线接口模块从所述单触发写状态跳转至所述结束态;当所述PCI芯片的本地总线满足所述起始有效地址信号等于0、读写指示信号等于0且传输结束标志信号等于1时,所述本地总线接口模块从所述初始态跳转至所述突发读状态;当所述PCI芯片的本地总线满足所述本地总线请求信号等于1且本地总线应答信号等于0时,所述本地总线接口模块从所述突发读状态跳转至所述结束态;当所述PCI芯片的本地总线满足下一个时钟信号的上升沿,所述本地总线接口模块从所述结束态跳转回到所述初始态。
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