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申请/专利权人：电子科技大学

摘要：本发明属于集成电路领域，具体为一种权重固定式的二维脉动阵列结构，包括多个脉动阵列单元；多个脉动阵列单元采用矩阵排布，形成二维脉动阵列结构；且该结构中每列最后一个脉动阵列单元均连接一个末级加法器。通过改进脉动阵列单元结构和脉动阵列单元间连接关系，使得乘法运算和加法运算能够在不同的流水线层运算，减少了最大组合逻辑延时，提高了对应电路所能支持的最高时钟频率，从而实现运算速率的提升。通过在在脉动阵列单元中引入权重存储器，将整个脉动阵列结构变为权重固定式，使其能够预先存入权重，在保证功能正确的情况下减少了数据的载入时间，且因为权重预先存入至脉动阵列单元中，降低了运算调度要求，提高了权重的复用性。

主权项：1.一种权重固定式的二维脉动阵列结构，包括多个脉动阵列单元；多个脉动阵列单元采用矩阵排布，形成二维脉动阵列结构，其特征在于：每个脉动阵列单元均包括四个输入端口、权重存储器、乘法运算单元，加法运算单元，乘法运算结果寄存器、输入数据寄存器、部分和寄存器；四个输入端口分别为输入数据端口、输入乘法结果端口、输入部分和端口、以及输入权重端口；权重存储器用于预存权重，其输入端连接输入权重端口，输出端连接乘法运算单元的第一输入端；乘法运算单元的第二输入端连接输入数据端口，输出端连接至乘法运算结果寄存器；加法运算单元的输入端连接输入乘法结果端口和输入部分和端口，输出端连接部分和寄存器；输入数据寄存器的输入端连接输入数据端口；二维脉动阵列结构中每列首个各脉动阵列单元的输入数据端口均连接外部输入至该二维脉动阵列结构的输入数据，输入乘法结果端口与部分和端口均为0；二维脉动阵列结构每一列的最后一个脉动阵列单元均连接一个末级加法器；末级加法器的输入端与对应列最后一个脉动阵列单元的乘法运算结果寄存器与部分和寄存器相连，输出端为二维脉动阵列结构的结构输出结果端；将任意一个m行n列脉动阵列单元在二维脉动阵列结构中地址记为i,j，i表示行，j表示列；该脉动阵列单元的乘法运算结果寄存器输出端连接地址为i+1,j的脉动阵列单元输入乘法结果端口；该脉动阵列单元的部分和寄存器输出端连接地址为i+1,j的输入部分和端口；该脉动阵列单元的输入数据寄存器连接地址为i+1,j-1的脉动阵列单元数据输入端口，若j＝1，则连接地址为i+1,n，其中m和n为大于1的整数，i为1-m的整数，j为1-n的整数。

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百度查询： 电子科技大学 一种权重固定式的二维脉动阵列结构