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申请/专利权人：中国科学院上海微系统与信息技术研究所
摘要：本发明公开了时钟树综合和布局混合优化方法和装置、存储介质和终端，其中方法包括获取所有时钟端口的坐标位置，并获取所有时钟端口的逻辑深度；基于所有时钟端口的逻辑深度对所有时钟端口分组得到多个逻辑深度组，并获取每个逻辑深度组的分割点；基于逻辑深度组的分割点计算主干节点，并连接形成时钟树主轨道；计算逻辑深度组中所有叶节点，并将其连接到时钟树主轨道上；将所有主干节点和所有叶节点转化为虚拟单元，并将所有虚拟单元和待优化电路版图内的所有逻辑门均作为可移动单元得到优化后的电路板图。本发明进一步提升了超导集成电路，尤其是SFQ逻辑中的Bit‑Slice电路结构的时钟树性能和布局效果，为后续电路的布线优化提供了更优化的版图布局。
主权项：1.一种时钟树综合和布局混合优化方法，包括：基于待优化电路的版图布局数据获取所述待优化电路中所有时钟端口的坐标位置，并基于所述待优化电路的电路网表获取所述待优化电路中所有时钟端口的逻辑深度；基于所有时钟端口的逻辑深度对所有时钟端口进行分组，得到多个逻辑深度组，并对每个所述逻辑深度组进行分割，得到每个所述逻辑深度组的分割点；分别以每个所述逻辑深度组的分割点作为参考节点计算每个所述逻辑深度组的主干节点，并依次连接所有所述主干节点形成时钟树主轨道；基于每个所述逻辑深度组中所有时钟端口坐标位置分别计算对应所述逻辑深度组中的所有叶节点，并将所有所述叶节点与所述时钟树主轨道连接；将所有主干节点和所有叶节点转化为虚拟单元，并将所有虚拟单元和所述待优化电路版图内的所有逻辑门作为同级别的可移动单元，通过利用基于模拟退火算法的布局优化器对所有所述可移动单元进行迭代优化，得到优化电路。
全文数据：
权利要求：
百度查询： 中国科学院上海微系统与信息技术研究所 时钟树综合和布局混合优化方法和装置、存储介质和终端
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