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申请/专利权人：百瑞互联集成电路(上海)有限公司

摘要：本申请公开了一种用于SOC的全数字频率综合器，属于集成电路技术领域。该综合器包括：数控振荡器，其输出差分信号；时间数字转换器，其与注入锁定缓冲器连接，接收其输出差分信号，并进行处理；分频器；数据选择器；调制器；多位计数器；第一锁存器；第二锁存器；周期性归一化模块；频率控制字单元；第一叠加单元；前馈多路激励抵消单元；第二叠加单元；滤波器，其与第二叠加单元连接，对第二叠加单元输出的叠加信号进行滤波处理，并将经过滤波处理的信号输出到调制器和数控振荡器中。本申请采用全数字工艺，设计一种全数字锁相环的结构，可以更好的发挥先进工艺的优势，产品设计时间周期短，复用率高，性能优异，可以更好的降低功耗，节约成本。

主权项：1.一种用于SOC的全数字频率综合器，其特征在于，包括：数控振荡器，其输出差分信号；缓冲器，其与所述数控振荡器连接，接收所述差分信号，进行缓冲处理后输出；时间数字转换器，其与所述缓冲器连接，接收其输出所述差分信号，并进行处理；分频器，其与所述时间数字转换器连接，接收其输出的所述差分信号，并按照预设分频比对信号进行处理并输出；数据选择器，其分别与所述分频器的第一输出口、第二输出口连接，接收其对应输出的分频信号，并进行信号选择；调制器，其与所述数据选择器连接，接收其输出的数据选择信号并进行处理，并将处理后的信号输入到所述数控振荡器的第一输入接口中；多位计数器，其与所述分频器的所述第一输出口连接，接收其对应输出的分频比信号，并进行计数；第一锁存器，其与所述时间数字转换器连接；第二锁存器，其与所述多位计数器连接；周期性归一化模块，其分别与所述第一锁存器和所述第二锁存器连接，对接收的信号进行同步处理，并输出；频率控制字单元，其输出频率控制字信号；第一叠加单元，其分别连接所述频率控制字单元和所述周期性归一化模块，对所述周期性归一化模块和频率控制字单元的输出信号进行叠加并输出；前馈多路激励抵消单元，其接收所述第一叠加单元的叠加信号并进行处理；第二叠加单元，其分别与所述前馈多路激励抵消单元和所述第一叠加单元连接，对所述前馈多路激励抵消单元的输出信号和所述第一叠加单元的叠加信号进行叠加；低通滤波器，其与所述第二叠加单元连接，对所述第二叠加单元输出的叠加信号进行滤波处理，并将经过滤波处理的信号输出到所述调制器和所述数控振荡器中。

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权利要求：

百度查询： 百瑞互联集成电路(上海)有限公司 用于SOC的全数字频率综合器及芯片