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申请/专利权人：武汉泰朴半导体有限公司
摘要：本发明提出了一种低压低功耗12位逐次逼近型AD转换器，属于模数转换器集成电路技术领域；包括：两自举开关用于将差分输入信号进行升压采样输出；两电容阵列分别与两自举开关和参考电压对应电性连接，包括若干权重电容对，用于接收自举开关输出的升压采样输出信号，进行电荷采样；比较器单元与两电容阵列电性连接，用于比较两电容阵列输出的信号；开关控制逻辑单元用于维持或者改变两电容阵列的若干权重电容对的下极板所接的电平；异步SAR逻辑模块用于生成异步时钟信号CLKC来作为比较器单元的比较和复位信号；异步SAR逻辑模块还驱动开关控制逻辑单元动作，按照权重电容对由高到低的次序逐个切换权重电容对并依次向比较器单元输出。
主权项：1.一种低压低功耗12位逐次逼近型AD转换器，其特征在于，包括：两自举开关（1），分别与采样时钟信号SAMPLE和一路差分输入信号VIN电性连接，用于将差分输入信号进行升压采样输出；两电容阵列（2），分别与两自举开关（1）和参考电压对应电性连接，包括若干权重电容对，用于接收自举开关（1）输出的升压采样输出信号，进行电荷采样；比较器单元（3），与两电容阵列（2）电性连接，用于比较两电容阵列（2）输出的信号，输出比较结果VOUTP和VOUTN，然后根据输出比较结果VOUTP和VOUTN生成VALID时钟信号；开关控制逻辑单元（4），用于维持或者改变两电容阵列（2）的若干权重电容对的下极板所接的电平；异步SAR逻辑模块（5），根据比较器单元（3）生成的VALID时钟信号和反相采样时钟信号SAMPLEB，用于生成异步时钟信号CLKC和动态逻辑输出，异步时钟信号CLKC提供给比较器单元（3），作为比较器单元（3）的比较和复位信号；动态逻辑输出作为对比较器单元（3）的输出比较结果VOUTP和VOUTN的锁存信号；异步SAR逻辑模块（5）还驱动开关控制逻辑单元（4）动作，按照权重电容对由高到低的次序逐个切换权重电容对并依次向比较器单元（3）输出。
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权利要求：
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