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申请/专利权人：电子科技大学
摘要：本发明提出一种多路并行跳时信号延时对齐及检测方法，属于跳时通信系统的检测处理技术领域。包括如下步骤：步骤S1：构造个双口RAM核，形成双口RAM环形缓冲空间；步骤S2：依据跳时信号的跳时间隔，装载双口RAM的初始主读地址，通过对读写地址的控制实现跳时信号的对齐；步骤S3：利用滑动互相关进行相关结果的计算，将相关结果与门限值比较完成定时同步检测。本发明具有灵活的延时时长参数可调特性，由于延时网络实现了流水线处理，搭配滑动互相关同步检测算法，能够极大地提高跳时接收机的吞吐量且FPGA资源消耗较小。
主权项：1.一种多路并行跳时信号延时对齐及检测方法，其特征在于，包括如下步骤：步骤S1：构造N个双口RAM核，形成双口RAM环形缓冲空间；步骤S2：依据跳时信号的跳时间隔，装载双口RAM的初始主读地址Arn0，通过对读写地址的控制实现跳时信号的延时对齐；第n路信号开始时刻为τn，N路信号的传输总时长为T，时钟周期为tclk，为使N路跳时信号传输完毕时，N路跳时信号对齐，第n路信号延时时间长度为T-τn，则Arn0＝L-T-τntclk；每个双口RAM环形缓冲空间的写地址都为Aw,0≤AwL，每个双口RAM环形缓冲空间的读地址为Arn,0≤ArnL,0≤nN，读地址和写地址在每个时钟时刻均会自加1，且当写地址和读地址溢出时均归零，读写地址控制通过如下公式实现： 其中，Awt+1表示t+1时刻第n个双口RAM环形缓冲空间的写地址，Awt表示t时刻第n个双口RAM环形缓冲空间的写地址，Arnt+1表示t+1时刻第n个双口RAM环形缓冲空间的读地址，Arnt表示t时刻第n个双口RAM环形缓冲空间的读地址；步骤S3：利用滑动互相关进行相关结果的计算，将相关结果与门限值比较完成定时同步检测。
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权利要求：
百度查询： 电子科技大学 一种多路并行跳时信号延时对齐及检测方法
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