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申请/专利权人：杭州慧芯达科技有限公司
摘要：本发明提供了一种紧耦合异构多核处理器架构及其处理方法，包括具有相互连接的主核CCore和从核PCore的核组结构，所述的核组结构中还包括有分别连接于主核CCore和从核PCore的多个一级数据缓存L1D，且多个一级数据缓存L1D均连接于二级缓存访问总线，所述的二级缓存访问总线连接于二级缓存L2Cache，所述的二级缓存L2Cache连接于访存总线，所述的访存总线连接于DMA和主存。本方案高效支持生产者‑消费者的缓冲管理，使数据预取与计算紧密耦合，有效提高访存带宽利用率。
主权项：1.一种紧耦合异构多核处理器架构，其特征在于，包括具有相互连接的主核CCore和从核PCore的核组结构，所述的核组结构中还包括有分别连接于主核CCore和从核PCore的多个一级数据缓存L1D，且多个一级数据缓存L1D均连接于二级缓存访问总线，所述的二级缓存访问总线连接于二级缓存L2Cache，所述的二级缓存L2Cache连接于访存总线，所述的访存总线连接于DMA和主存；所述的二级缓存L2Cache中具有多个环形缓冲区，且至少一个环形缓冲区用于缓存计算结果数据，至少一个环形缓冲区用于缓存从主存中导入的计算数据并对不规则数据进行规则排列；主核CCore用于预先分析从核PCore所需的计算数据的存储地址，并协调DMA将计算数据从主存导入二级缓存L2Cache；以及，用于在计算结果数据被写入二级缓存L2Cache时再次协调DMA将计算结果数据从二级缓存L2Cache写入主存；从核PCore用于将自己所需的计算数据从所述的二级缓存L2Cache获取到就近一级数据缓存L1D进行计算，并通过所述就近一级数据缓存L1D将计算结果数据写入到二级缓存L2Cache。
全文数据：
权利要求：
百度查询： 杭州慧芯达科技有限公司 一种紧耦合异构多核处理器架构及其处理方法
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