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申请/专利权人：艾迪悌科技有限公司
摘要：本申请涉及用于准确信号生成的反馈控制。锁相环PLL通过进入保持模式418并在保持模式下将反馈时钟fbclk与第二参考时钟对准，从而执行从第一参考时钟ref1到第二参考时钟ref2的无中断切换。通过调节用于多模式分频器128的除数输入D来执行对准，多模式分频器128对输出时钟频率PLLout进行分频以生成反馈时钟。还提供其他特征。
主权项：1.一种用于操作锁相环PLL的方法，所述方法包括：根据第一参考时钟操作所述PLL；然后将所述PLL从所述第一参考时钟切换到第二参考时钟；以及根据所述第二参考时钟操作所述PLL；其中根据作为所述第一参考时钟和所述第二参考时钟之一的参考时钟操作所述PLL包括：生成PLL输出信号以及根据所述PLL输出信号生成反馈信号，其中生成所述PLL输出信号包括：由第一电路136,140生成第一误差信号，所述第一误差信号指示所述参考时钟与所述反馈信号之间的对准；以及响应于所述第一误差信号，生成所述PLL输出信号；其中将所述PLL从所述第一参考时钟切换到所述第二参考时钟包括：将所述PLL置于保持模式中，其中独立于所述第一参考时钟和所述第二参考时钟而生成所述PLL输出信号；在处于所述保持模式下时，响应于第二误差信号，控制根据所述PLL输出信号对所述反馈信号的生成，所述第二误差信号指示所述第二参考时钟和所述反馈信号之间的对准，所述第二误差信号由第二电路生成。
全文数据：
权利要求：
百度查询： 艾迪悌科技有限公司 用于准确信号生成的反馈控制
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