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摘要：本发明提供了一种基于数据校正的高可靠DDR控制器系统，在DDR控制器的初始化过程或者DDR控制器的工作过程中，持续监视DDR控制器的状态标识信号，异常时产生系统复位信号，对DDR控制器的时钟管理单元及操作控制逻辑进行自动复位，对DDR控制器重新初始化及训练校准；在DDR控制器初始化之后，通过对DDR芯片预写数据并回读比对的方式，进一步判断DDR控制器的健康状态，异常时产生系统复位信号，对DDR控制器重新初始化及训练校准；在DDR芯片级联使用时，通过共用控制逻辑及读数据缓存对齐的方式，提升DDR控制器的可靠性；在DDR控制器的存取数据时，通过在读写数据流中嵌入RS编译码，提升DDR控制器的可靠性。
主权项：1.一种基于数据校正的高可靠DDR控制器系统，其特征在于包括DDR芯片、DDR控制器、自复位模块；DDR控制器采用MIGIP核实现，包括写数据FIFO、读数据FIFO、命令和地址复用FIFO、用户接口和DDR芯片接口；写数据FIFO用于接收外部输入的待写入DDR芯片的数据；读数据FIFO用于读取DDR芯片内的数据；命令和地址复用FIFO用于产生控制DDR芯片的读写逻辑和DDR芯片的地址，将外部输入的用户数据通过写数据FIFO写入DDR芯片内对应地址；将DDR芯片对应地址的数据读出通过读数据FIFO发送用户；用户接口信号包括初始化完成标识phy_init_done、写数据FIFO满状态标识app_wdf_afull、写数据FIFO的写使能app_wdf_wren、写数据FIFO的写数据app_wdf_data、命令和地址复用FIFO满状态标识app_af_afull、命令和地址复用FIFO的写使能app_af_wren、读写控制命令app_af_cmd、读写逻辑地址app_af_addr、读数据FIFO的输出使能rd_data_valid、读数据FIFO的输出数据rd_data_fifo_out；DDR芯片接口包括DDR芯片的读写控制接口、地址接口和数据接口。
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百度查询： 西安空间无线电技术研究所 基于数据校正的高可靠DDR控制器系统
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