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摘要：本发明公开了基于可配置逻辑的优化KV存储性能的硬件及其实施方法，包括如下硬件实现流程：采用CRC作为HASH函数，并且支持17种选择，即CRC16~CRC32；采用链地址法解决HASH冲突问题，并且同一条链按照key的大小从小到大排列；通过调整HASH函数来调节HEADZONE的Entry个数；其中，Key_info_buf为包含key和指向value指针的单元。本发明是基于一种新的KV存储形式的KV‑SSD开展的研究，基于HASH的实现，通过一种可配置的逻辑实现硬件加速，并且根据实际应用可以实时调整读写性能。
主权项：1.基于可配置逻辑的优化KV存储性能的硬件，其特征在于，包括如下硬件实现流程：采用CRC作为HASH函数，并且支持17种选择，即CRC16~CRC32；采用链地址法解决HASH冲突问题，并且同一条链按照key的大小从小到大排列；通过调整HASH函数来调节HEADZONE的Entry个数；其中，Key_info_buf为包含key和指向value指针的单元。
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