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申请/专利权人：苏州长风航空电子有限公司
摘要：本发明提供了一种2lane的LVDS视频编码方法及系统，该系统包括：同步码嵌入模块、LVDS编码模块、锁相环模块和复位模块；同步码嵌入模块用于将hi3559接收数据所需要的同步码信息嵌入到视频流中；LVDS编码模块采用FIFO_16to32模块、FIFO_16to8模块和8bit_to_1bit模块将视频流数据重组在2条lane上并实现并串转化；锁相环模块用于提供LVDS编码模块的编码时钟；复位模块用于确保fifo正常工作，在每次初始化LVDS编码模块的时候复位fifo，再通过延时模块依次开启fifo。本发明可以在hi3559硬件带宽要求下，为hi3559提供小于1080P的任意分辨率的2laneLVDS编码视频信号。
主权项：1.一种2lane的LVDS视频编码方法，其特征在于，包括如下步骤：1视频数据通过同步码嵌入模块，完成同步码的嵌入；2通过FIFO_16to32模块将相邻两个16bit的像素点组合为32bit的视频数据；3输出的图像数据分别对高16位和低16位进行同步打拍处理，再输入给FIFO_16to8模块，FIFO_16to8模块将16位的数据分成前后两个8位数据；4输出的视频流信号通过触发器进行同步处理；5将视频数据给到8bit_to_1bit模块，对8bit的数据进行串行化处理得到串行数据；6将串行化的视频数据通过单端转差分模块输出FPGA；其中，所述的同步码的嵌入，是在同步码嵌入模块中先把后续分开相邻像素所需要同步码结对嵌入到视频流中；其中，将相邻图像数据分布在不同的两个lane上，且这两个像素点数据变成同步数据；所述的FIFO_16to32模块输入的时钟是clk1，输出时钟是二分频的clk2；所述的FIFO_16to8模块输入时钟是二分频的clk2，输出时钟是像素时钟clk1。
全文数据：
权利要求：
百度查询： 苏州长风航空电子有限公司 一种2 lane的LVDS视频编码方法及系统
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