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申请/专利权人：成都电科星拓科技有限公司

摘要：本发明公开了一种校正ADPLL中DTC步长的方法。为避免DTC步长不准确缺陷，本发明校正ADPLL中DTC步长的方法包括如下步骤：所述DTC接收频率控制字的小数部分、参考时钟、DTC系数校正模块输出的DTC转换系数和抖动生成模块输出的抖动值，所述DTC输出目标延迟相位至DTC系数校正模块，并且所述DTC输出延迟后的参考时钟和相位补偿值至TDC；所述TDC接收延迟后的参考时钟、DCO输出时钟、TDC转换系数和相位补偿值，并输出相位误差的小数部分。本发明准确性高，相噪谱上的毛刺少且幅度低，展频模式下不会产生额外抖动。

主权项：1.一种校正ADPLL中DTC步长的方法，其特征在于，包括如下步骤：所述DTC接收频率控制字的小数部分、参考时钟、DTC系数校正模块输出的DTC转换系数和抖动生成模块输出的抖动值，所述DTC输出目标延迟相位至DTC系数校正模块，并且所述DTC输出延迟后的参考时钟和相位补偿值至TDC；所述TDC接收延迟后的参考时钟、DCO输出时钟、TDC转换系数和相位补偿值，并输出相位误差的小数部分；此外，所述ADPLL包括所述DTC、所述TDC和DCO，所述DCO生成所述DCO输出时钟；所述DTC系数校正模块接收相位误差和目标延迟相位，并通过如下步骤获得DTC转换系数：目标延迟相位和相位误差相乘后再与第一增益系数相乘，然后与第二结果的先前值相加后获得第二结果；第二结果与第二增益系数相乘后再与第三结果相加，获得DTC转换系数；DTC转换系数的先前值与第二增益系数相乘，然后再加上DTC转换系数的先前值，获得所述第三结果；所述DTC包括DTC核心电路，且在DTC中执行如下步骤：频率控制字的小数部分乘以负一后再加上1，得到目标延迟相位；抖动生成模块输出的抖动值乘以抖动增益幅度后，再乘以负一后，得到相位补偿值；抖动生成模块输出的抖动值乘以抖动增益幅度后，加上频率控制字的小数部分后，得到第一结果；DTC转换系数经过取倒数后，与第一结果相乘，并经过取整后，获得DTC码值；DTC码值与参考时钟作为DTC核心电路的输入，DTC核心电路输出延迟后的参考时钟；其中，所述DTC核心电路是执行数字至时间转换的电路。

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