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基于平均步长的校正ADPLL中TDC步长的方法 

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申请/专利权人:成都电科星拓科技有限公司

摘要:本发明公开了一种基于平均步长的校正ADPLL中TDC步长的方法。为降低TDC步长波动对ADPLL性能的影响,本发明TDC接收DCO输出时钟和参考时钟,并通过DCO输出时钟生成多个延迟的DCO输出时钟分别对参考时钟进行采样,获得TDC码字;然后根据TDC码字获得一个参考时钟周期内的步长数和步长值;TDC系数校正模块根据平均步长,获得TDC转换系数并输出至TDC,所述TDC转换系数等于平均步长乘以DCO输出时钟频率。本发明可以克服因温度、工艺、电压等环境因素对TDC步长的影响,提升ADPLL输出时钟的性能。

主权项:1.一种基于平均步长的校正ADPLL中TDC步长的方法,其特征在于,包括如下步骤:初始化计数值为零,以及初始化总步长值为零;在所述计数值达到最大计数值前,累加步长值至总步长值,并令计数值自增一;当所述计数值达到最大计数值时,获得平均步长,所述平均步长等于总步长值除以最大计数值;TDC系数校正模块根据平均步长,获得TDC转换系数并输出至TDC,所述TDC转换系数等于平均步长乘以DCO输出时钟频率;并且,通过如下方法获得步长值:TDC接收DCO输出时钟和参考时钟,并通过DCO输出时钟生成多个延迟的DCO输出时钟分别对参考时钟进行采样,获得TDC码字;根据TDC码字获得一个参考时钟周期内的步长数和步长值,其中,步长值等于1(参考时钟频率×步长数);此外,所述ADPLL包括TDC和DCO,所述DCO输出时钟来自所述DCO;所述TDC码字中包括至少3段连续1或连续0,其中1代表参考时钟为高电平,0代表参考时钟为低电平。

全文数据:

权利要求:

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