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申请/专利权人：科洛斯巴股份有限公司
摘要：本申请涉及用于非易失性存储器的灵活且可配置的位错误率降低。改进的用于非易失性存储器的位错误校正可分多个阶段实现，从而提高改进能力。作为示例，一组数据的位错误校正可利用应用于该组数据的一个或多个副本N的逻辑或差分演算法来产生逻辑或差分输出。错误校正码ECC可应用于逻辑或差分输出以产生校正数据，该校正数据校正该组数据的位错误如果有，最多可达所选ECC的最大值。可选择演算法来解决非易失性存储器的测量的位错误率或二进制位状态之间的位错误率变化。
主权项：1.一种用于读取多个非易失性存储器胞的方法，其特征在于，包括：在第一个时钟周期中：读取第一组非易失性存储器胞的数据值；读取第二组非易失性存储器胞的第二数据值，其中，该第二数据值是该数据值的副本；在另一个时钟周期中：对该数据值和该第二数据值进行按位逻辑运算，并生成逻辑输出数据集；以及对该逻辑输出数据集执行错误校正码ECC演算法，并校正为该逻辑输出数据集识别的位错误。
全文数据：
权利要求：
百度查询： 科洛斯巴股份有限公司 用于非易失性存储器的灵活且可配置的位错误率降低
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